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參數(shù)資料
| 型號(hào)： | MB91FV130CR-ES |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-Bit RISC Microcontroller |
| 中文描述： | 32-BIT, 33 MHz, RISC MICROCONTROLLER, CPGA299 |
| 封裝： | CERAMIC, PGA-299 |
| 文件頁數(shù)： | 91/123頁 |
| 文件大小： | 1362K |
| 代理商： | MB91FV130CR-ES |
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MB91133/MB91F133
91
4.
AC Characteristics
(1) Clock Timing Standard
(MASK Model V
CC
5
=
AV
CC
=
DAVC
=
5.0 V
±
10
%
, V
CC
3
=
2.7 V to 3.6 V, V
SS
=
AV
SS
=
0 V, T
A
=
40
°
C to
+
70
°
C)
(FLASH Model V
CC
5
=
AV
CC
=
DAVC
=
5.0 V
±
10
%
, V
CC
3
=
3.0 V to 3.6 V, V
SS
=
AV
SS
=
0 V, T
A
=
40
°
C to
+
70
°
C)
*1 : Frequency fluctuation rate indicates the maximum fluctuation ratio from the setting central frequency during
locking in case of doubling.
*2 : The targeted analog areas are the A/D and level comparator.
Parameter
Sym-
bol
Pin name
Condi-
tions
Value
Unit
Remarks
Min.
Max.
Clock frequency
(high-speed, self-oscillation)
f
C
X0, X1
9
16.5
MHz
Self oscillation
available area
Clock frequency
(high-speed, PLL usage)
PLL usable area by
self-oscillation input
Clock frequency (low-speed)
f
CA
X0A, X1A
32
kHz
Self oscillation
Clock cycle time
t
C
30.3
31250
ns
Frequency fluctuation rate
*1
(when PLL locked)
f
10
%
Internal operation
clock frequency
CPU
system
f
CP
0.032
33
MHz
Bus
system
f
CPB
0.032
25
Peripheral
system
f
CPP
0.032
25
Excluding analog
area
*2
1
25
Analog area
*2
Internal operation
clock cycle time
CPU
system
t
CP
30.3
31250
ns
Bus
system
t
CPB
40
31250
Peripheral
system
t
CPP
40
31250
Excluding analog
area
*2
40
1000
Analog area
*2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MB91F133PBT | 32-Bit RISC Microcontroller |
| MB91133PBT | 32-Bit RISC Microcontroller |
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| MB91133 | 32-Bit RISC Microcontroller |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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