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參數資料
| 型號： | MC56F8346 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 56F8346 16-bit Hybrid Controller |
| 中文描述： | 56F8346 16位混合控制器 |
| 文件頁數： | 109/160頁 |
| 文件大小： | 1415K |
| 代理商： | MC56F8346 |
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Register Descriptions
56F8346 Technical Data
Preliminary
109
6.5.9.5
Each bit controls clocks to the indicated peripheral.
Decoder 1 Enable (DEC1)—Bit 11
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.6
Each bit controls clocks to the indicated peripheral.
Decoder 0 Enable (DEC0)—Bit 10
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.7
Each bit controls clocks to the indicated peripheral.
Quad Timer D Enable (TMRD)—Bit 9
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.8
Each bit controls clocks to the indicated peripheral.
Quad Timer C Enable (TMRC)—Bit 8
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.9
Each bit controls clocks to the indicated peripheral.
Quad Timer B Enable (TMRB)—Bit 7
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.10 Quad Timer A Enable (TMRA)—Bit 6
Each bit controls clocks to the indicated peripheral.
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.11 Serial Communications Interface 1 Enable (SCI1)—Bit 5
Each bit controls clocks to the indicated peripheral.
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
6.5.9.12 Serial Communications Interface 0 Enable (SCI0)—Bit 4
Each bit controls clocks to the indicated peripheral.
1 = Clocks are enabled
0 = The clock is not provided to the peripheral (the peripheral is disabled)
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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