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參數資料
| 型號： | MC68HC08AS32 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCUs) With Embedded EEPROM For User Data Storage(8位微控制器單元(MCUs)，帶嵌入式EEPROM數據存儲單元) |
| 中文描述： | 8位微控制器單元（MCU）與嵌入式對于用戶數據存儲（8位微控制器單元（MCU）的，帶嵌入式EEPROM的數據存儲單元的EEPROM） |
| 文件頁數： | 335/394頁 |
| 文件大小： | 3174K |
| 代理商： | MC68HC08AS32 |
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Byte Data Link Controller-Digital (BDLC-D)
BDLC MUX Interface
MC68HC08AS32
—
Rev. 3.0
Advance Information
MOTOROLA
Byte Data Link Controller-Digital (BDLC-D)
335
L
G
R
receiving a message in 4X mode, the BDLC detects a BREAK
symbol, it treats the BREAK as a reception error, sets the invalid
symbol flag, and exits 4X mode (for example, the RX4XE bit in BCR2
is cleared automatically). If bus control is required after the BREAK
symbol is received and the IFS time has elapsed, the programmer
must resend the transmission byte using highest priority.
NOTE:
The J1850 protocol BREAK symbol is not related to the HC08 break
module (See
Section 11. Break Module (Break)
.)
IDLE — Idle Bus
An idle condition exists on the bus during any passive period after
expiration of the IFS period (for instance,
≥
300
μ
s). Any node sensing
an idle bus condition can begin transmission immediately.
20.5.3 J 1850 VPW Symbols
Huntsinger’s variable pulse width modulation (VPW) is an encoding
technique in which each bit is defined by the time between successive
transitions and by the level of the bus between transitions (for instance,
active or passive). Active and passive bits are used alternately. This
encoding technique is used to reduce the number of bus transitions for
a given bit rate.
Each logic 1 or logic 0 contains a single transition and can be at either
the active or passive level and one of two lengths, either 64
μ
s or 128
μ
s
(t
NOM
at 10.4 kbps baud rate), depending upon the encoding of the
previous bit. The start-of-frame (SOF), end-of-data (EOD), end-of-frame
(EOF), and inter-frame separation (IFS) symbols always will be encoded
at an assigned level and length. See
Figure 20-6
.
Each message will begin with an SOF symbol an active symbol and,
therefore, each data byte (including the CRC byte) will begin with a
passive bit, regardless of whether it is a logic 1 or a logic 0.
All VPW bit lengths stated in the following descriptions are typical values
at a 10.4 kbps bit rate.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC08AZ16 | HCMOS Microcontroller Unit |
| MC68HC08AZ24 | HCMOS Microcontroller Unit |
| MC68HC08AZ32 | 8-Bit Microcontroller Units (MCU).(8位微控制器) |
| MC68HC08AZ60AMFU | Microcontrollers |
| MC68HC08AZ60AVFU | CONTACT |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68HC08AZ0 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| MC68HC08AZ0CFU | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| MC68HC08AZ16 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC08AZ24 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC08AZ32 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information |
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