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參數資料
| 型號： | MC68HC08AS32 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 8-Bit Microcontroller Units (MCUs) With Embedded EEPROM For User Data Storage(8位微控制器單元(MCUs)，帶嵌入式EEPROM數據存儲單元) |
| 中文描述： | 8位微控制器單元（MCU）與嵌入式對于用戶數據存儲（8位微控制器單元（MCU）的，帶嵌入式EEPROM的數據存儲單元的EEPROM） |
| 文件頁數： | 359/394頁 |
| 文件大小： | 3174K |
| 代理商： | MC68HC08AS32 |
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Byte Data Link Controller-Digital (BDLC-D)
BDLC CPU Interface
MC68HC08AS32
—
Rev. 3.0
Advance Information
MOTOROLA
Byte Data Link Controller-Digital (BDLC-D)
359
L
G
R
TEOD — Transmit End of Data Bit
This bit is set by the programmer to indicate the end of a message is
being sent by the BDLC. It will append an 8-bit CRC after completing
transmission of the current byte. This bit also is used to end an
in-frame response (IFR). If the transmit shadow register is full when
TEOD is set, the CRC byte will be transmitted after the current byte in
the Tx shift register and the byte in the Tx shadow register have been
transmitted. (See
20.6.3 Rx and Tx Shadow Registers
for a
description of the transmit shadow register.) Once TEOD is set, the
transmit data register empty flag (TDRE) in the BDLC state vector
register (BSVR) is cleared to allow lower priority interrupts to occur.
(See
20.7.4 BDLC State Vector Register
.)
1 = Transmit end-of-data (EOD) symbol
0 = The TEOD bit will be cleared automatically at the rising edge of
the first CRC bit that is sent or if an error is detected. When
TEOD is used to end an IFR transmission, TEOD is cleared
when the BDLC receives back a valid EOD symbol or an error
condition occurs.
TSIFR, TMIFR1, and TMIFR0 — Transmit In-Frame Response
Control Bits
These three bits control the type of in-frame response being sent. The
programmer should not set more than one of these control bits to a 1
at any given time. However, if more than one of these three control
bits are set to 1, the priority encoding logic will force these register bits
to a known value as shown in
Table 20-5
. For example, if 011 is
written to TSIFR, TMIFR1, and TMIFR0, then internally they will be
encoded as 010. However, when these bits are read back, they will
read 011.
Table 20-5. BDLC Transmit In-Frame Response
Control Bit Priority Encoding
Write/Read
TSIFR
Write/Read
TMIFR1
Write/Read
TMIFR0
Actual
TSIFR
Actual
TMIFR1
Actual
TMIFR0
0
0
0
0
0
0
1
X
X
1
0
0
0
1
X
0
1
0
0
0
1
0
0
1
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC08AZ16 | HCMOS Microcontroller Unit |
| MC68HC08AZ24 | HCMOS Microcontroller Unit |
| MC68HC08AZ32 | 8-Bit Microcontroller Units (MCU).(8位微控制器) |
| MC68HC08AZ60AMFU | Microcontrollers |
| MC68HC08AZ60AVFU | CONTACT |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68HC08AZ0 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| MC68HC08AZ0CFU | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Advance Information |
| MC68HC08AZ16 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC08AZ24 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:HCMOS Microcontroller Unit |
| MC68HC08AZ32 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Advance Information |
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