- 您現在的位置：買賣IC網 > PDF目錄192296 > S29CL016J0MFAM100 (SPANSION LLC) 512K X 32 FLASH 3.3V PROM, 54 ns, PBGA80 PDF資料下載
參數資料
| 型號： | S29CL016J0MFAM100 |
| 廠商： | SPANSION LLC |
| 元件分類： | PROM |
| 英文描述： | 512K X 32 FLASH 3.3V PROM, 54 ns, PBGA80 |
| 封裝： | 13 X 11 MM, 1 MM PITCH, FORTIFIED, BGA-80 |
| 文件頁數： | 57/78頁 |
| 文件大小： | 1825K |
| 代理商： | S29CL016J0MFAM100 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁當前第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁
58
S29CD-J & S29CL-J Flash Family
S29CD-J_CL-J_00_B1 September27,2006
Prel imi n ary
18.3 Synchronous Operations
Notes:
1.
Using the max tAAVS and min tADVCS specs together will result in incorrect data output.
2. Not 100% tested
3. Recommended 50% Duty Cycle
Table 18.3 Burst Mode Read for 32 Mb and 16 Mb
Parameter
Description
Speed Options
Unit
JEDEC
Std.
75MHz, OR 66MHz, OP 56MHz, OM 40MHz, OJ
tBACC
Burst Access Time Valid Clock to Output Delay
Max
7.5 FBGA
8
ns
tADVCS ADV# Setup Time to Rising Edge of CLK
Min
6
ns
tADVCH ADV# Hold Time from Rising Edge of CLK
Min
1.5
ns
tADVP
ADV# Pulse Width
Min
7.5
8.5
9.5
10.5
ns
tBDH
Valid Data Hold from CLK (Note 2)
Min
2
3
ns
tINDS
CLK to Valid IND/WAIT# (Note 2)
Max
7.5 FBGA
9 FBGA
9.5 PQFP
10 FBGA
10 PQFP
17
ns
tINDH
IND/WAIT# Hold from CLK (Note 2)
Min
2
3
ns
tIACC
ADV or ADD Valid (Whichever Occurs Last) to Valid
Data Out, Initial Burst Access
Max
48
54
ns
tCLK
CLK Period
Min
13.3
15.15
17.85
25
ns
Max
60
tCR
CLK Rise Time (Note 2)
Max
3
ns
tCF
CLK Fall Time (Note 2)
Max
3
ns
tCLKH
CLK High Time (Note 3)
Min
6.65
6.8
8.0
11.25
ns
tCLKL
CLK Low Time (Note 3)
Min
6.65
27
ns
tOE
Output Enable to Output Valid
Max
20
ns
tDF
tOEZ
Output Enable to Output High Z (Note 2)
Min
2
3
ns
Max
7.5
10
15
17
tEHQZ
tCEZ
Chip Enable to Output High Z (Note 2)
Max
7.5
10
15
17
ns
tCES
CE# Setup Time to Clock
Min
4
5
6
ns
tAAVS
ADV# Falling Edge to Address Valid (Note 1)
Max
6.5
ns
tAAVH
Address Hold Time from Rising Edge of AVD#
Min
15
ns
tRSTZ
RESET# Low to Output High Z (Note 2)
Max
7.5
10
15
17
ns
tWADVH1 ADV# Falling Edge to WE# Falling Edge
Min
5
ns
tWADVH2 ADV# Rising Edge to WE# Rising Edge
Min
10
ns
相關PDF資料 |
PDF描述 |
|---|---|
| S29CL016J0PFFM102 | 512K X 32 FLASH 3.3V PROM, 54 ns, PBGA80 |
| S29CL016J1JFFM112 | 512K X 32 FLASH 3.3V PROM, 54 ns, PBGA80 |
| S29CD032J1JFAN110 | 1M X 32 FLASH 2.7V PROM, 54 ns, PBGA80 |
| S29CD032J1JFFN020 | 1M X 32 FLASH 2.7V PROM, 54 ns, PBGA80 |
| S29CL032J0RFAI113 | 1M X 32 FLASH 3.3V PROM, 48 ns, PBGA80 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| S29CL016J0MQFM030 | 制造商:Spansion 功能描述: |
| S29CL016J0MQFM030P | 制造商:Spansion 功能描述:32M (4MX8/2MX16) 3V REG, MIRRORBIT, TOP, FBGA48, IND - Trays |
| S29CL016J1JFAI020 | 制造商:Spansion 功能描述:16 - Tape and Reel |
| S29CL032J0MFAI030 | 制造商:Spansion 功能描述:32MBIT FLASH - Trays |
| S29CL032J0PQFM010 | 制造商:Spansion 功能描述: 制造商:Spansion 功能描述:32MBIT FLASH - Tape and Reel |
發布緊急采購，3分鐘左右您將得到回復。