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參數(shù)資料
| 型號(hào)： | TSPC106AMGS83CE |
| 英文描述： | MEMORY CONTROLLER |
| 中文描述： | 內(nèi)存控制器 |
| 文件頁(yè)數(shù)： | 9/40頁(yè) |
| 文件大小： | 569K |
| 代理商： | TSPC106AMGS83CE |
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9
TSPC106
2102B
–
HIREL
–
02/02
Figure 4.
Symbol
Note:
Some signals have dual functions and are shown more than once in this figure.
A[0:31]
AD[31:0]
PAR
PCI
Interface
Memory
Interface
Interrupt, Clock
and Power
Management
Signals
Configuration
60x
Processor
Interface
L2 Cache/
Multiple
Processor
Interface
IEEE 1149.1
JTAG
Interface
C/BE[3:0]
RAS[0:7]
TRDY
IRDY
FRAME
STOP
LOCK
DEVSEL
SERR, PERR
ISA_MASTER
REQ
GNT
FLSHREQ
MEMACK
PIRQ
CAS[0:7]
WE
MA0/AR0
MA[1:12]/AR[9:20]
PAR[0:7]/AR[1:8]
FOE
(1)
MDLE, PPEN
RCS1
BCTL0, BCTL1
RTC
SYSCLK, CKO
(1)
HRST
NMI
QREQ
QACK
SUSPEND
DBG0
FOE
(1)
RCS0
(1)
RCS0
(1)
PLL[0:3]
32
4
1
1
1
1
1
1
1
1
1
1
1
2
1
1
8
8
1
1
12
8
1
2
1
1
2
1
2
1
1
1
1
1
1
1
1
4
BR0
BG0
TS
XATS
TT[0:4]
TSIZ[0:2]
TBST
WT, CI, GBL
AACK
ARTRY
DBG0
(1)
DH[0:31], DL[0:31]
TA
LBCLAIM
DBGLB
MCP, TEA
ADS/DALE/BRL2
BAA/BA1/BGL2
DOE/DBGL2
DWE[0:2]/DBG2, DBG3, CKO
(1)
HIT
DCS/BG3
BA0/BR3
TWE/BG2
TV/BR2
DIRTY_IN/BR1
DIRTY_OUT/BG1
TOE/DBG1
TDO
TDI
TCK
TMS
TRST
1
1
1
1
32
5
3
1
1
1
1
64
1
1
1
3
2
1
1
1
3
1
1
1
1
1
1
1
1
1
1
1
1
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TSPC106AMGS83CG | MEMORY CONTROLLER |
| TSPC106AVGU66CE | MEMORY CONTROLLER |
| TSPC106AVGU66CG | MEMORY CONTROLLER |
| TSPC106AVGU83CE | MEMORY CONTROLLER |
| TSPC106AVGU83CG | MEMORY CONTROLLER |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TSPC106AMGS83CG | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEMORY CONTROLLER |
| TSPC106AMGSB/Q66CE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEMORY CONTROLLER |
| TSPC106AMGSB/Q66CG | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEMORY CONTROLLER |
| TSPC106AMGSB/Q83CE | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEMORY CONTROLLER |
| TSPC106AMGSB/Q83CG | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEMORY CONTROLLER |
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