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參數(shù)資料
| 型號： | ADSP-21160NKB-95 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | DSP Microcomputer |
| 中文描述： | 64-BIT, 47.5 MHz, OTHER DSP, PBGA400 |
| 封裝： | 27 X 27 MM, METRIC, PLASTIC, BGA-400 |
| 文件頁數(shù)： | 33/53頁 |
| 文件大小： | 1680K |
| 代理商： | ADSP-21160NKB-95 |
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PRELIMINARY TECHNICAL DATA
This information applies to a product under development. Its characteristics and specifications are subject to change without notice. Analog
Devices assumes no obligation regarding future manufacturing unless otherwise agreed to in writing.
33
REV. PrB
For current information contact Analog Devices at 800/262-5643
ADSP-21160N
April 2002
Asynchronous Read/Write—Host to ADSP-21160N
Use these specifications (
Table 15
and
Table 16
) for asynchronous host processor accesses of an ADSP-21160N, after the
host has asserted
CS
and
HBR
(low). After
HBG
is returned by the ADSP-21160N, the host can drive the
RDx
and
WRx
pins to access the ADSP-21160N’s internal memory or IOP registers.
HBR
and
HBG
are assumed low for this timing
Table 15. Read Cycle
Parameter
Timing Requirements:
t
SADRDL
t
HADRDH
t
WRWH
t
DRDHRDY
t
DRDHRDY
Switching Characteristics:
t
SDATRDY
t
DRDYRDL
t
RDYPRD
t
HDARWH
Min
Max
Unit
Address Setup/
CS
Low Before
RDx
Low
Address Hold/
CS
Hold Low After
RDx
RDx
/
WRx
High Width
RDx
High Delay After REDY (O/D) Disable
RDx
High Delay After REDY (A/D) Disable
0
2
5
0
0
ns
ns
ns
ns
ns
Data Valid Before REDY Disable from Low
REDY (O/D) or (A/D) Low Delay After
RDx
Low
REDY (O/D) or (A/D) Low Pulsewidth for Read
Data Disable After RDx High
2
ns
ns
ns
ns
11
t
CK
- 3
2
6
Figure 22. Read Cycle (Asynchronous Read—Host to ADSP-21160N)
READ CYCLE
REDY (O/D)
RDx
ADDRESS/
CS
DATA (OUT)
REDY (A/D)
t
SADRDL
t
DRD YRD L
t
WRWH
t
HADRDH
t
HDARWH
t
RDYPRD
t
DRDHRDY
t
SDATRDY
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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