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參數(shù)資料
型號(hào)： ADSP-BF561SBB500
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號(hào)處理
英文描述： Blackfin Embedded Symmetric Multi-Processor
中文描述： 32-BIT, 500 MHz, OTHER DSP, PBGA297
封裝： PLASTIC, MS-0340AAL-1, BGA-297
文件頁(yè)數(shù)： 44/52頁(yè)
文件大小： 508K
代理商： ADSP-BF561SBB500
Rev. PrC
|
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April 2004
ADSP-BF561
Preliminary Technical Data
CAPACITIVE LOADING
Output delays and holds are based on standard capacitive loads:
30 pF on all pins (see
Figure 26 on Page 44
).
Figure 25
shows
graphically how output delays and holds vary with load capaci-
tance (Note that this graph or derating does not apply to output
disable delays; see
Output Disable Time on Page 43
). The graphs
of
Figure 25
,
Figure 27
and
Figure 28
may not be linear outside
the ranges shown, for Typical Output Delay vs. Load Capaci-
tance and Typical Output Rise Time (10%-90%, V=Min) vs.
Load Capacitance.
Figure 26. Equivalent Device Loading for AC Measurements (Includes All
Fixtures)
Figure 27. Typical Output Rise/Fall Time (10%-90%, Vddext = Max)
1.5V
20pF
TO
OUTPUT
PIN
50
V
LOAD CAPACITANCE - pF
16.0
8.0
00
200
20
40
60
80
100
120
140
160
180
14.0
12.0
4.0
2.0
10.0
6.0
R
(
TBD
Figure 28. Typical Output Rise/Fall Time (10%-90%, Vddext = Min)
LOAD CAPACITANCE - pF
2.0
00
200
20
40
60
80
100
120
140
160
180
3.5
3.0
1.0
0.5
2.5
1.5
R
(
TBD
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PDF描述
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