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參數資料
| 型號： | HM17CM256 |
| 廠商： | HYNIX SEMICONDUCTOR INC |
| 元件分類： | 顯示驅動器 |
| 英文描述： | 128XRGBX82 OUTPUT LCD DRIVER IC with built-in RAM |
| 中文描述： | LIQUID CRYSTAL DISPLAY DRIVER, UUC580 |
| 封裝： | 19.75 X 2.39 MM, GOLD BUMP, DIE-580 |
| 文件頁數： | 99/111頁 |
| 文件大小： | 2094K |
| 代理商： | HM17CM256 |
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HM17CM256
- 99 -
SYSTEM BUS READ / WRITE TIMING (68 series CPU interface)
(write timing
ú
(V
DD
=2.7
～
3.3V, Ta=-30
～
+85
°
C)
MAX.
UNIT
ns
ns
ITEM
SYMBOL
t
AH6
t
AS6
CONDITION
MIN.
TBD
TBD
PORT
CS
RS
Address hold timing
Address setup timing
System cycle timing
Enable ”L” pulse width
Enable ”H” pulse width
t
CYC6
t
ELW6
t
EHW6
TBD
TBD
TBD
ns
ns
ns
E
Data setup timing
Data hold timing
t
DS6
t
DH6
TBD
TBD
ns
ns
D
0
～
D
15
(V
DD
=2.4
～
2.7V, Ta=-30
～
+85
°
C)
MAX.
UNIT
ns
ns
ITEM
SYMBOL
t
AH6
t
AS6
CONDITION
MIN.
TBD
TBD
PORT
CS
RS
Address hold timing
Address setup timing
System cycle timing
Enable ”L” pulse width
Enable ”H” pulse width
t
CYC6
t
ELW6
t
EHW8
TBD
TBD
TBD
ns
ns
ns
E
Data setup timing
Data hold timing
t
DS6
t
DH6
TBD
TBD
ns
ns
D
0
～
D
15
(V
DD
=1.7
～
2.4V, Ta=-30
～
+85
°
C)
MAX.
UNIT
ns
ns
ITEM
SYMBOL
t
AH6
t
AS6
CONDITION
MIN.
TBD
TBD
PORT
CS
RS
Address hold timing
Address setup timing
System cycle timing
Enable ”L” pulse width
Enable ”H” pulse width
t
CYC6
t
ELW6
t
EHW6
TBD
TBD
TBD
ns
ns
ns
E
Data setup timing
Data hold timing
notice) All timing reference is 20% and 80% of V
DD
and 80%.
t
DS6
t
DH6
TBD
TBD
ns
ns
D
0
～
D
15
t
AS6
CS
RS
t
AH6
R/W
(WR)
D
0
～
D
15
t
EHW6
t
ELW6
t
DS6
t
DH6
t
CYC6
E
(RD)
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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