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參數資料
| 型號： | ISP1161ABD |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Full-speed Universal Serial Bus single-chip host and device controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64 |
| 文件頁數： | 106/134頁 |
| 文件大小： | 587K |
| 代理商： | ISP1161ABD |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁當前第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁
Philips Semiconductors
ISP1161A
Full-speed USB single-chip host and device controller
Product data
Rev. 03 — 23 December 2004
106 of 134
9397 750 13962
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
13.3.5
Read Chip ID (R: B5H)
This command reads the chip identification code and hardware version number. The
firmware must check this information to determine the supported functions and
features. This command accesses the DcChipID register, which is shown in
Table 106
.
Code (Hex): B5 —
read chip ID
Transaction —
read 1 word
13.3.6
Read Interrupt register (R: C0H)
This command indicates the sources of interrupts as stored in the 4-byte DcInterrupt
register. Each individual endpoint has its own interrupt bit. The bit allocation of the
DcInterrupt register is shown in
Table 108
. Bit BUSTATUS is used to verify the current
bus status in the interrupt service routine. Interrupts are enabled via the Interrupt
Enable register, see
Section 13.1.5
.
Remark:
While reading the DcInterrupt register, it is recommended that both 2 byte
words are read completely.
Code (Hex): C0 —
read interrupt register
Transaction —
read 2 words
Remark:
For details on interrupt control, see
Section 8.6.3
.
Table 105: Example of DcFrameNumber register access
A0
Phase
Bus lines
1
command
D[7:0]
D[15:8]
0
data
D[15:0]
Word #
-
-
0
Description
command code (B4H)
ignored
frame number
Table 106: DcChipID register: bit allocation
Bit
15
Symbol
Reset
0
Access
R
Bit
7
Symbol
Reset
0
Access
R
14
13
12
11
10
9
8
CHIPIDH[7:0]
0
R
4
CHIPIDL[7:0]
0
R
1
R
6
1
R
5
0
R
3
0
R
2
0
R
1
1
R
0
0
R
1
R
0
R
0
R
1
R
0
R
Table 107: DcChipID register: bit description
Bit
Symbol
15 to 8
CHIPIDH[7:0]
7 to 0
CHIPIDL[7:0]
Description
chip ID code (61H)
silicon version (22H)
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1161ABM | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161 | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161A1 | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BD | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BM | Universal Serial Bus single-chip host and device controller |
相關代理商/技術參數 |
參數描述 |
|---|---|
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