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參數資料
| 型號： | ISP1161ABD |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Full-speed Universal Serial Bus single-chip host and device controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64 |
| 文件頁數： | 77/134頁 |
| 文件大小： | 587K |
| 代理商： | ISP1161ABD |
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Philips Semiconductors
ISP1161A
Full-speed USB single-chip host and device controller
Product data
Rev. 03 — 23 December 2004
77 of 134
9397 750 13962
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
11. USB device controller (DC)
The Device Controller (DC) in the ISP1161A is based on the Philips ISP1181B USB
Full-Speed Interface Device IC. The functionality, commands, and register sets are
the same as ISP1181B in 16-bit bus mode. If there are any differences between the
ISP1181B and ISP1161A data sheets, in terms of the DC functionality, the ISP1161A
data sheet supersedes content in the ISP1181B data sheet.
In general the DC in an ISP1161A provides 16 endpoints for USB device
implementation. Each endpoint can be allocated an amount of RAM space in the
on-chip Ping-Pong buffer RAM.
Remark:
The Ping-Pong buffer RAM for the DC is independent of the buffer RAM in
the HC.
When the buffer RAM is full, the DC will transfer the data in the buffer RAM to the
USB bus. When the buffer RAM is empty, an interrupt is generated to notify the
microprocessor to feed in the data. The transfer of data between the microprocessor
and the DC can be done in Programmed I/O (PIO) mode or in DMA mode.
11.1 DC data transfer operation
The following session explains how the DC of an ISP1161A handles an IN data
transfer and an OUT data transfer. In the Device mode, ISP1161A acts as a USB
device: an IN data transfer means transfer from ISP1161A to an external USB Host
(through the upstream port) and an OUT transfer means transfer from external USB
Host to ISP1161A.
11.1.1
IN data transfer
The arrival of the IN token is detected by the SIE by decoding the PID.
The SIE also checks for the device number and endpoint number and verifies
whether they are acceptable.
If the endpoint is enabled, the SIE checks the contents of the DcEndpointStatus
register. If the endpoint is full, the contents of the FIFO are sent during the data
phase, otherwise a Not Acknowledge (NAK) handshake is sent.
After the data phase, the SIE expects a handshake (ACK) from the host (except for
ISO endpoints).
On receiving the handshake (ACK), the SIE updates the contents of the
DcEndpointStatus register and the DcInterrupt register, which in turn generates an
interrupt to the microprocessor. For ISO endpoints, the interrupt register is updated
as soon as data is sent because there is no handshake phase.
On receiving an interrupt, the microprocessor reads the DcInterrupt register. It will
know which endpoint has generated the interrupt and reads the contents of the
corresponding DcEndpointStatus register. If the buffer is empty, it fills up the buffer,
so that data can be sent by the SIE at the next IN token phase.
11.1.2
OUT data transfer
The arrival of the OUT token is detected by the SIE by decoding the PID.
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1161ABM | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161 | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161A1 | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BD | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BM | Universal Serial Bus single-chip host and device controller |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| ISP1161ABD,151 | 功能描述:USB 接口集成電路 DO NOT USE ORDER ISP1161A1BD RoHS:否 制造商:Cypress Semiconductor 產品:USB 2.0 數據速率: 接口類型:SPI 工作電源電壓:3.15 V to 3.45 V 工作電源電流: 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:WLCSP-20 |
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