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參數資料
| 型號： | ISP1181BDGG |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Full-speed Universal Serial Bus peripheral controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PDSO48 |
| 封裝： | 6.10 MM, PLASTIC, MO-153, SOT-362-1, TSSOP-48 |
| 文件頁數： | 55/70頁 |
| 文件大小： | 341K |
| 代理商： | ISP1181BDGG |
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Philips Semiconductors
ISP1181B
Full-speed USB peripheral controller
Product data
Rev. 02 — 07 December 2004
55 of 70
9397 750 13958
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
Read in DACK-only mode (see
Figure 26
)
t
ASRP
DREQ off after DACK on
t
ASAP
DACK pulse width
t
ASAP
+ t
APRS
DREQ on after DACK off
t
ASDV
data valid after DACK on
t
APDZ
data hold after DACK off
Write in DACK-only mode (see
Figure 27
)
t
ASRP
DREQ off after DACK on
t
ASAP
+ t
APRS
DREQ on after DACK off
t
DVAP
data setup before DACK off
t
APDZ
data hold after DACK off
Single-cycle EOT (see
Figure 28
)
t
RSIH
input RD/WR HIGH after
DREQ on
t
IHAP
DACK off after input RD/WR
HIGH
t
EOT
EOT pulse width
-
25
90
-
-
40
-
-
22
3
-
25
180
-
-
40
-
-
22
3
ns
ns
ns
ns
ns
-
90
5
3
40
-
-
-
-
180
5
3
40
-
-
-
ns
ns
ns
ns
22
-
22
-
ns
0
-
0
-
ns
EOT on;
DACK on;
RD/WR LOW
22
-
22
-
ns
t
RLIS
t
WLIS
input EOT on after RD LOW
input EOT on after WR LOW
-
-
22
22
-
-
89
89
ns
ns
Table 59:
Symbol
Dynamic characteristics: single-cycle DMA timing
…continued
Parameter
Conditions
8-bit bus
Min
16-bit bus
Min
Unit
Max
Max
Fig 25. DMA timing in 8237 compatible mode.
MGS792
DREQ
DACK
tASRP
Tcy(DREQ)
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1181 | Full-speed Universal Serial Bus Interface Device(全速通用串行總線接口器件) |
| ISP1181DGG | INDUCTOR 4.7NH +-.3NH 0402 SMD |
| ISP1183 | Low-power Universal Serial Bus interface device with DMA |
| ISP1183BS | Low-power Universal Serial Bus interface device with DMA |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| ISP1181BPC | 制造商:ST-Ericsson 功能描述:Full-Speed Universal Serial Bus Peripheral Controller |
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