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參數(shù)資料
| 型號： | ISP1362BD |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Single-chip Universal Serial Bus On-The-Go controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64 |
| 文件頁數(shù)： | 102/150頁 |
| 文件大小： | 647K |
| 代理商： | ISP1362BD |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁當(dāng)前第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁
Philips Semiconductors
ISP1362
Single-chip USB OTG controller
Product data
Rev. 03
—
06 January 2004
102 of 150
9397 750 12337
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
Code (Hex): 40
—
read
Code (Hex): C0
—
write
The HCD is
fi
rst required to initialize the HcTransferCounter register with the byte
count to be transferred and check the HcBufferStatus register. The HCD then sends
the command (40H for reading from the ISTL0 buffer, and C0H for writing to the
ISTL0 buffer) to the HC through the I/O port of the microprocessor. After the
command is sent, the HCD starts reading data from the ISTL0 buffer or writing data to
the ISTL0 buffer. While the HCD is accessing the buffer, the buffer pointer of ISTL0
also increases automatically. When the pointer has reached the initialized byte count
of the HcTransferCounter register, the HC sets the AllEOTInterrupt bit of the
Hc
μ
PInterrupt register to logic 1 and updates the HcBufferStatus register.
15.7.3
HcISTL1BufferPort register (R/W: 42H/C2H)
In addition to the HcDirectAddressData register, the ISP1362 provides this register to
act as another data port for accessing the ISTL1 buffer. The starting address for
accessing the buffer is always
fi
xed at 0000H. Therefore, random access of the ISTL1
buffer is not allowed. The bit description of the register is given in
Table 82
.
Code (Hex): 42
—
read
Code (Hex): C2
—
write
The HCD is
fi
rst required to initialize the HcTransferCounter register with the byte
count to be transferred and check the HcBufferStatus register. The HCD then sends
the command (42H for reading from the ISTL1 buffer, and C2H for writing to the
ISTL1 buffer) to the HC through the I/O port of the microprocessor. After the
command is sent, the HCD starts reading data from the ISTL1 buffer or writing data to
the ISTL1 buffer. While the HCD is accessing the buffer, the buffer pointer of ISTL1
also increases automatically. When the pointer has reached the initialized byte count
of the HcTransferCounter register, the HC sets the AllEOTInterrupt bit in the
Hc
μ
PInterrupt register to logic 1 and updates the HcBufferStatus register.
15.7.4
HcISTLToggleRate register (R/W: 47H/C7H)
The rate of toggling between ISTL0 and ISTL1 is programmable. The
HcISTLToggleRate register is provided for programming the required toggle rate in
the range of 0 ms to 15 ms at intervals of 1 ms. The bit allocation of the register is
shown in
Table 83
.
Code (Hex): 47
—
read
Code (Hex): C7
—
write
Table 81:
Bit
15 to 0
HcISTL0BufferPort register: bit description
Symbol
Access Value
DataWord
[15:0]
Description
The data in the ISTL0 buffer to be accessed
through this data port.
R/W
0000H
Table 82:
Bit
15 to 0
HcISTL1BufferPort register: bit description
Symbol
Access Value
DataWord
[15:0]
Description
The data in the ISTL1 buffer to be accessed
through this data port.
R/W
0000H
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PDF描述 |
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