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參數資料
| 型號： | P89LPC931 |
| 英文描述： | 8-bit microcontrollers with two-clock 80C51 core 4 kB/8 kB 3 V Flash with 256-byte data RAM |
| 中文描述： | 8位微控制器兩個小時80C51的核心4 KB的/ 8 KB的256 3伏閃存內存字節的數據 |
| 文件頁數： | 42/54頁 |
| 文件大小： | 1015K |
| 代理商： | P89LPC931 |
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Philips Semiconductors
P89LPC930/931
8-bit microcontrollers with two-clock 80C51 core
Product data
Rev. 03 — 06 October 2003
42 of 54
9397 750 12122
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
11. Dynamic characteristics
Table 8:
T
amb
=
40
°
C to +85
°
C for industrial, unless otherwise specified.
[1]
Symbol
Parameter
AC characteristics
Conditions
Variable clock
Min
7.189
280
f
OSC
= 12 MHz
Min
7.189
280
Unit
Max
7.557
480
Max
7.557
480
f
RCOSC
f
WDOSC
internal RC oscillator frequency
internal Watchdog oscillator
frequency
oscillator frequency
clock cycle
CLKLP active frequency
MHz
kHz
f
OSC
t
CLCL
f
CLKP
Glitch filter
0
83
0
12
-
4
-
-
-
-
-
-
MHz
ns
MHz
see
Figure 20
glitch rejection, P1.5/RST pin
signal acceptance, P1.5/RST pin
glitch rejection, any pin except
P1.5/RST
signal acceptance, any pin except
P1.5/RST
External clock
t
CHCX
HIGH time
t
CLCX
LOW time
t
CLCH
rise time
t
CHCL
fall time
Shift register (UART mode 0)
t
XLXL
serial port clock cycle time
t
QVXH
output data set-up to clock rising
edge
t
XHQX
output data hold after clock rising
edge
t
XHDX
input data hold after clock rising
edge
t
DVXH
input data valid to clock rising edge
SPI interface
f
SPI
Operating frequency
2.0 MHz (Master)
2.0 MHz (Slave)
3.0 MHz (Master)
3.0 MHz (Slave)
t
SPICYC
Cycle time
-
125
-
50
-
15
-
125
-
50
-
15
ns
ns
ns
50
-
50
-
ns
see
Figure 20
see
Figure 20
see
Figure 20
see
Figure 20
33
33
-
-
t
CLCL
t
CLCX
t
CLCL
t
CHCX
8
8
33
33
-
-
-
-
8
8
ns
ns
ns
ns
16 t
CLCL
13 t
CLCL
-
-
1333
1083
-
-
ns
ns
-
t
CLCL
+ 20
-
103
ns
-
0
-
0
ns
150
-
150
-
ns
-
0
-
0
-
2.0
-
3.0
-
0
-
0
-
2.0
-
3.0
MHz
MHz
MHz
MHz
see Figures
15
,
16
,
17
,
18
2.0 MHz (Master)
2.0 MHz (Slave)
3.0 MHz (Master)
3.0 MHz (Slave)
-
500
-
333
-
-
-
-
-
500
-
333
-
-
-
-
ns
ns
ns
ns
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