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參數資料
| 型號： | TPS65950ZXNT |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA209 |
| 封裝： | 7 X 7 MM, 0.40 MM PITCH, PLASTIC, BGA-209 |
| 文件頁數： | 33/167頁 |
| 文件大小： | 2566K |
| 代理商： | TPS65950ZXNT |
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9.3.1
Sequence Conversion Time (Real-Time or Nonaborted Asynchronous)
TPS65950
Integrated Power Management/Audio Codec
SWCS032 – OCTOBER 2008
www.ti.com
Table 9-2. Analog Input Voltage Range
Channel
Min(1)
Typ(2)
Max(3)
Unit
Prescaler
No prescaler
ADIN0: Battery type/GP input
0
1.5
V
Dc current source for battery identification through external
resistor (10
A typical)
No prescaler
ADIN1: Battery temperature
0
1.5
V
Dc current source for temperature measurement through
external resistor (10 to 80
A programmable)
ADIN2: GP input(4)
0
2.5
V
MADC prescaler from 0 to >1.5 V
ADIN3: GP input(4)
0
2.5
V
MADC prescaler from 0 to >1.5 V
ADIN4: GP input(4)
0
2.5
V
MADC prescaler from 0 to >1.5 V
ADIN5: GP input(4)
0
2.5
V
MADC prescaler from 0 to >1.5 V
ADIN6: GP input(4)
0
2.5
V
MADC prescaler from 0 to >1.5 V
ADIN7: GP input(4)
0
2.5
V
MADC prescaler from 0 to >1.5 V
(1)
Min = Minimum value
(2)
Typ = Typical value
(3)
Max = Maximum value
(4)
GP inputs must be tied to ground when TPS65950 internal power supplies (VINTANA1 and VINTANA2) are off.
Table 9-3 lists the sequence conversion timing characteristics. Figure 9-1 is a conversion sequence
general timing diagram.
Table 9-3. Sequence Conversion Timing Characteristics
Parameter
Comments
Min(1)
Typ(2) Max(3)
Unit
F
Running frequency
1
MHz
T = 1/F
Clock period
1
s
N
Number of analog inputs to convert in a single sequence
0
16
Tstart
SW1, SW2, or USB asynchronous request or real-time STARTADC
3
4
s
request
Tsettling time
Settling time to wait before sampling a stable analog input (capacitor
5
12
20
s
bank charge time)
Tsettling is calculated from the max((Rs + Ron)*Cbank) of the 16
possible input sources (internal or external). Ron is the resistance of
the selection analog input switches (5 k
). This time is
software-programmable in the open-core protocol (OCP) register.
Tstartsar
The successive approximation registers ADC start time
1
s
Tadc time
The successive approximation registers ADC conversion time
10
s
Tcapture time
Tcapture time is the conversion result capture time.
2
s
Tstop
1
2
s
Full conversion sequence
One channel (N = 1)(4)
22
39
s
time
All channels (N = 16)(4)
352
624
Without Tstart and Tstop: One channel (N = 1)(4)
18
33
Conversion sequence
s
time
Without Tstart and Tstop: All channels (N = 16)(4)
288
528
STARTADC pulse
STARTADC period is T
0.33
24
s
duration
(1)
Min = Minimum value
(2)
Typ = Typical value
(3)
Max = Maximum value
(4)
Total sequence conversion time general formula: Tstar t+ N*(1 + Tsettling + Tadc + Tcapture) +Tstop
MADC
128
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