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參數資料
| 型號： | TS88915T |
| 英文描述： | TS88915T [Updated 6/02. 19 Pages] Low Skew CMOS PLL Clock Driver. 3 state 70 and 100 MHZ versions |
| 中文描述： | TS88915T [更新6月2日。 19頁]低偏移的CMOS PLL時鐘驅動器。 3國70和100兆赫的版本 |
| 文件頁數： | 13/19頁 |
| 文件大小： | 333K |
| 代理商： | TS88915T |
13
TS88915T
2122A–HIREL–06/02
put would run twice the SYNC frequency, and the Q/2 output would run at half
the SYNC frequency. See Figure 7, Figure 8 and Figure 9 below.
Figure 8.
Wiring Diagram and Frequency Relationship with Q/2 Output Feed Back
Figure 9.
Wiring Diagram and Frequency Relationship with Q4 Output Feed Back
50 MHz FEEDBACK SIGNAL
Figure 10.
Wiring Diagram and Frequency Relationship with 2X_Q Output Feed Back
100 MHz FEEDBACK SIGNAL
25 MHz FEEDBACK SIGNAL
100 MHz SIGNAL
CRYSTAL
OSC.
EXTERNAL
LOOP
FILTER
25 MHz INPUT
LOW
50 MHz
"Q"
CLOCK
OUTPUTS
HIGH
HIGH
HIGH
FEEDBACK
REF_SEL
SYNC[0]
ANALOG VCC
RC1
ANALOG GND
FQ_SEL
Q0
Q1
PLL_EN
Q/2
Q3
Q2
RST
Q5
Q4
2X_Q
100 MHz SIGNAL
CRYSTAL
OSC.
EXTERNAL
LOOP
FILTER
50 MHz INPUT
LOW
50 MHz
"Q"
CLOCK
OUTPUTS
HIGH
HIGH
HIGH
FEEDBACK
REF_SEL
SYNC[0]
ANALOG VCC
RC1
ANALOG GND
FQ_SEL
Q0
Q1
PLL_EN
Q/2
Q3
Q2
RST
Q5
Q4
2X_Q
25 MHz
SIGNAL
CRYSTAL
OSC.
EXTERNAL
LOOP
FILTER
100 MHz INPUT
LOW
50 MHz
"Q"
CLOCK
OUTPUTS
HIGH
HIGH
HIGH
FEEDBACK
REF_SEL
SYNC[0]
ANALOG VCC
RC1
ANALOG GND
FQ_SEL
Q0
Q1
PLL_EN
Q/2
Q3
Q2
RST
Q5
Q4
2X_Q
25 MHz
SIGNAL
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PDF描述 |
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