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參數資料
| 型號： | 71V3577YS80PF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | SRAM |
| 英文描述： | 128K X 36 CACHE SRAM, 8 ns, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, TQFP-100 |
| 文件頁數： | 4/22頁 |
| 文件大小： | 621K |
| 代理商： | 71V3577YS80PF |
6.42
12
IDT71V3577YS_79YS, IDT71V3577YSA_79YSA, 128K x 36, 256K x 18, 3.3V Synchronous SRAMs with
3.3V I/O, Flow-Through Outputs, Burst Counter, Single Cycle Deselect
Commercial and Industrial Temperature Ranges
AC Electrical Characteristics
(VDD = 3.3V ±5%, Commercial and Industrial Temperature Ranges)
6.5ns(5)
7.5ns(5)
8ns
8.5ns
Symbol
Parameter
Min.
Max.
Min. Max.
Min.
Max.
Min.
Max.
Unit
Clock Parameter
tCYC
Clock Cycle Time
7.5
____
8.5
____
10
____
11.5
____
ns
tCH(1)
Clock High Pulse Width
2.5
____
3
____
4
____
4.5
____
ns
tCL
(1)
Clock Low Pulse Width
2.5
____
3
____
4
____
4.5
____
ns
Output Parameters
tCD
Clock High to Valid Data
____
6.5
____
7.5
____
8
____
8.5
ns
tCDC
Clock High to Data Change
2
____
2
____
2
____
2
____
ns
tCLZ
(2)
Clock High to Output Active
0
____
0
____
0
____
0
____
ns
tCHZ
(2)
Clock High to Data High-Z
2
3.5
2
3.5
2
3.5
2
3.5
ns
tOE
Output Enable Access Time
____
3.5
____
3.5
____
3.5
____
3.5
ns
tOLZ
(2)
Output Enable Low to Output Active
0
____
0
____
0
____
0
____
ns
tOHZ(2)
Output Enable High to Output High-Z
____
3.5
____
3.5
____
3.5
____
3.5
ns
Set Up Times
tSA
Address Setup Time
1.5
____
1.5
____
2
____
2
____
ns
tSS
Address Status Setup Time
1.5
____
1.5
____
2
____
2
____
ns
tSD
Data In Setup Time
1.5
____
1.5
____
2
____
2
____
ns
tSW
Write Setup Time
1.5
____
1.5
____
2
____
2
____
ns
tSAV
Address Advance Setup Time
1.5
____
1.5
____
2
____
2
____
ns
tSC
Chip Enable/Select Setup Time
1.5
____
1.5
____
2
____
2
____
ns
Hold Times
tHA
Address Hold Time
0.5
____
0.5
____
0.5
____
0.5
____
ns
tHS
Address Status Hold Time
0.5
____
0.5
____
0.5
____
0.5
____
ns
tHD
Data In Hold Time
0.5
____
0.5
____
0.5
____
0.5
____
ns
tHW
Write Hold Time
0.5
____
0.5
____
0.5
____
0.5
____
ns
tHAV
Address Advance Hold Time
0.5
____
0.5
____
0.5
____
0.5
____
ns
tHC
Chip Enable/Select Hold Time
0.5
____
0.5
____
0.5
____
0.5
____
ns
Sleep Mode and Configuration Parameters
tZZPW
ZZ Pulse Width
100
____
100
____
100
____
100
____
ns
tZZR(3)
ZZ Recovery Time
100
____
100
____
100
____
100
____
ns
tCFG(4)
Configuration Set-up Time
30
____
34
____
40
____
50
____
ns
6450 tbl 16
NOTES:
1. Measured as HIGH above VIH and LOW below VIL.
2. Transition is measured ±200mV from steady-state.
3. Device must be deselected when powered-up from sleep mode.
4. tCFG is the minimum time required to configure the device based on the
LBO input. LBO is a static input and must not change during normal operation.
5. Commercial temperature range only.
相關PDF資料 |
PDF描述 |
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| 7P2FLV511I15 | 1M X 16 FLASH 3V PROM CARD, 150 ns, XMA68 |
| 7P6FLV221C15 | 3M X 16 FLASH 3V PROM CARD, 150 ns, XMA68 |
| 7P12FLV212I15 | 6M X 16 FLASH 3V PROM CARD, 150 ns, XMA68 |
相關代理商/技術參數 |
參數描述 |
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| 71V3578S133PFG8 | 功能描述:靜態隨機存取存儲器 256Kx18 SYNC 3.3V FLOW-THROUGH 靜態隨機存取存儲器 RoHS:否 制造商:Cypress Semiconductor 存儲容量:16 Mbit 組織:1 M x 16 訪問時間:55 ns 電源電壓-最大:3.6 V 電源電壓-最小:2.2 V 最大工作電流:22 uA 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 安裝風格:SMD/SMT 封裝 / 箱體:TSOP-48 封裝:Tray |
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