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參數資料
| 型號： | AD9995KCPRL |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費家電 |
| 英文描述： | 12-Bit CCD Signal Processor with Precision Timing ⑩ Generator |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, QCC56 |
| 封裝： | 8 X 8 MM, MO-220-VLLD-2, LFCSP-56 |
| 文件頁數： | 44/60頁 |
| 文件大小： | 1593K |
| 代理商： | AD9995KCPRL |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁當前第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁
AD9995
–44–
Table XXVII. V-Pattern Group 1 (VPAT1) Register Map (continued)
Data Bit Default
Address Content
13
Value
0
0
0
0
0
0
0
0
0
0
Register Name
V5TOG1_1
V5TOG2_1
V5TOG3_1
V6TOG1_1
V6TOG2_1
V6TOG3_1
FREEZE1_1
RESUME1_1
FREEZE2_1
RESUME2_1
Description
V5 Toggle Position 1
V5 Toggle Position 2
V5 Toggle Position 3
V6 Toggle Position 1
V6 Toggle Position 2
V6 Toggle Position 3
V1–V6 Freeze Position 1
V1–V6 Resume Position 1
V1–V6 Freeze Position 2
V1–V6 Resume Position 2
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
14
15
16
17
Table XXVIII. V-Pattern Group 2 (VPAT2) Register Map
Data Bit Default
Address Content
18
Value
0
0
0
Register Name
VPOL_2
UNUSED
VPATLEN_2
Description
VPAT2 Start Polarity. V1[0]. V2[1]. V3[2]. V4[3]. V5[4]. V6[5].
Unused.
Total Length of VPAT2. Note: If using VPAT2 as a second V-sequence in
the VSG active line, this value is the start position for the second V-sequence.
V1 Toggle Position 1
V1 Toggle Position 2
V1 Toggle Position 3
V2 Toggle Position 1
V2 Toggle Position 2
V2 Toggle Position 3
V3 Toggle Position 1
V3 Toggle Position 2
V3 Toggle Position 3
V4 Toggle Position 1
V4 Toggle Position 2
V4 Toggle Position 3
V5 Toggle Position 1
V5 Toggle Position 2
V5 Toggle Position 3
V6 Toggle Position 1
V6 Toggle Position 2
V6 Toggle Position 3
V1–V6 Freeze Position 1
V1–V6 Resume Position 1
V1–V6 Freeze Position 2
V1–V6 Resume Position 2
[5:0]
[11:6]
[23:12]
19
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
[11:0]
[23:12]
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
V1TOG1_2
V1TOG2_2
V1TOG3_2
V2TOG1_2
V2TOG2_2
V2TOG3_2
V3TOG1_2
V3TOG2_2
V3TOG3_2
V4TOG1_2
V4TOG2_2
V4TOG3_2
V5TOG1_2
V5TOG2_2
V5TOG3_2
V6TOG1_2
V6TOG2_2
V6TOG3_2
FREEZE1_2
RESUME1_2
FREEZE2_2
RESUME2_2
1A
1B
1C
1D
1E
1F
20
21
22
23
Table XXIX. V-Pattern Group 3 (VPAT3) Register Map
Data Bit Default
Address Content
24
Value
0
0
0
Register Name
VPOL_3
UNUSED
VPATLEN_3
Description
VPAT3 Start Polarity. V1[0]. V2[1]. V3[2]. V4[3]. V5[4]. V6[5].
Unused.
Total Length of VPAT3. Note: If using VPAT3 as a second V-sequence in
the VSG active line, this value is the start position for the second V-sequence.
V1 Toggle Position 1
V1 Toggle Position 2
[5:0]
[11:6]
[23:12]
25
[11:0]
[23:12]
0
0
V1TOG1_3
V1TOG2_3
REV. 0
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