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參數資料
| 型號： | ADSP-2163BP-100 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | RECTIFIER FAST-RECOVERY SINGLE 1.5A 100V 50A-ifsm 1V-vf 50ns 5uA-ir DO-15 1K/BULK |
| 中文描述： | 24-BIT, 25 MHz, OTHER DSP, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁數： | 27/39頁 |
| 文件大小： | 243K |
| 代理商： | ADSP-2163BP-100 |
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REV. 0
ADSP-216x
–27–
TIMING PARAMETERS (ADSP-2161/ADSP-2163/ADSP-2165)
SERIAL PORTS
13.824 MHz*
Min
Frequency Dependency
Min
Parameter
Max
Max
Unit
Timing Requirements:
t
SCK
t
SCS
t
SCH
t
SCP
Switching Characteristics:
t
CC
t
SCDE
t
SCDV
t
RH
t
RD
t
SCDH
t
TDE
t
TDV
t
SCDD
t
RDV
SCLK Period
DR/TFS/RFS Setup Before SCLK Low
DR/TFS/RFS Hold After SCLK Low
SCLK
IN
Width
72.3
8
10
28
72.3
8
10
28
ns
ns
ns
ns
CLKOUT High to SCLK
OUT
SCLK High to DT Enable
SCLK High to DT Valid
TFS/RFS
OUT
Hold After SCLK High
TFS/RFS
OUT
Delay from SCLK High
DT Hold After SCLK High
TFS (Alt) to DT Enable
TFS (Alt) to DT Valid
SCLK High to DT Disable
RFS (Multichannel, Frame Delay Zero)
to DT Valid
18.1
0
33.1
0.25t
CK
0
0.25t
CK
+ 15
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
20
20
0
0
20
20
0
0
0
0
18
25
20
18
25
20
*Maximum serial port operating frequency is 13.824 MHz for all processor speed grades.
CLKOUT
SCLK
DT
t
CC
t
CC
t
SCS
t
SCH
t
RH
t
SCDE
t
SCDH
t
SCDD
t
TDE
t
RDV
DR
TFS
IN
RFS
IN
RFS
OUT
TFS
OUT
t
TDV
t
SCDV
t
RD
t
SCP
t
SCK
t
SCP
(ALTERNATE
FRAME MODE)
RFS
(MULTICHANNEL MODE,
FRAME DELAY 0 {MFD = 0})
Figure 26. Serial Ports
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-2163BP-66 | DSP Microcomputers with ROM |
| ADSP-2163BS-100 | 100V 1A ULTRA FAST LOW-LOSS CONTROLLED AVALANCHE RECTIFIER, SMA US1 SERIES, DO- |
| ADSP-2163BS-66 | DSP Microcomputers with ROM |
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相關代理商/技術參數 |
參數描述 |
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