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參數資料
| 型號： | ADSP-2163BP-100 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | RECTIFIER FAST-RECOVERY SINGLE 1.5A 100V 50A-ifsm 1V-vf 50ns 5uA-ir DO-15 1K/BULK |
| 中文描述： | 24-BIT, 25 MHz, OTHER DSP, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁數： | 32/39頁 |
| 文件大小： | 243K |
| 代理商： | ADSP-2163BP-100 |
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REV. 0
ADSP-216x
–32–
TIMING PARAMETERS (ADSP-2162/ADSP-2164/ADSP-2166)
MEMORY READ
10.24 MHz
Min
13.0 MHz
Min
16.67 MHz
Min
Frequency Dependency
Min
Parameter
Max
Max
Max
Max
Unit
Timing Requirements:
t
RDD
RD
Low to Data Valid
t
AA
A0–A13,
PMS
,
DMS
,
BMS
to
Data Valid
t
RDH
Data Hold from
RD
High
Switching Characteristics:
t
RP
RD
Pulsewidth
t
CRD
CLKOUT High to
RD
Low
t
ASR
A0–A13,
PMS
,
DMS
,
BMS
Setup Before
RD
Low
t
RDA
A0–A13,
PMS
,
DMS
,
BMS
Hold After
RD
Deasserted
t
RWR
RD
High to
RD
or
WR
Low
33.8
23.5
15
0.5t
CK
– 15 + w
ns
49.2
33.7
21
0.75t
CK
– 24 + w
ns
ns
0
0
0
0
43.8
19.4
33.25
14.2
25
10.0
0.5t
CK
– 5 + w
0.25t
CK
– 5
ns
ns
34.4
29.2
25.0
0.25t
CK
+ 10
12.4
7.2
3.0
0.25t
CK
– 12
ns
14.4
38.8
9.2
28.5
5.0
20.0
0.25t
CK
– 10
0.5t
CK
– 10
ns
ns
w = wait states
×
t
CK.
CLKOUT
A0–A13
D
t
RDA
t
RWR
t
RP
t
ASR
t
CRD
t
RDD
t
AA
t
RDH
DMS
,
PMS
,
BMS
RD
WR
Figure 30. Memory Read
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-2163BP-66 | DSP Microcomputers with ROM |
| ADSP-2163BS-100 | 100V 1A ULTRA FAST LOW-LOSS CONTROLLED AVALANCHE RECTIFIER, SMA US1 SERIES, DO- |
| ADSP-2163BS-66 | DSP Microcomputers with ROM |
| ADSP-2163KS-100 | DSP Microcomputers with ROM |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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