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參數資料
| 型號： | ISP1161ABM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Full-speed Universal Serial Bus single-chip host and device controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-414-1, LQFP-64 |
| 文件頁數： | 20/134頁 |
| 文件大小： | 587K |
| 代理商： | ISP1161ABM |
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Philips Semiconductors
ISP1161A
Full-speed USB single-chip host and device controller
Product data
Rev. 03 — 23 December 2004
20 of 134
9397 750 13962
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
There are two groups of interrupts represented by group 1 and group 2 in
Figure 20
.
A pair of registers control each group.
Group 2 contains six possible interrupt events (recorded in the HcInterruptStatus
register). On occurrence of any of these events, the corresponding bit would be set to
logic 1; and if the corresponding bit in the HcInterruptEnable register is also logic 1,
the 6-input OR gate would output logic 1. This output is ANDed with the value of MIE
(bit 31 of HcInterruptEnable). Logic 1 at the AND gate will cause bit OPR in the
Hc
μ
PInterrupt register to be set to logic 1.
Group 1 contains six possible interrupt events, one of which is the output of group 2
interrupt sources. The Hc
μ
PInterrupt and Hc
μ
PInterruptEnable registers work in the
same way as the HcInterruptStatus and HcInterruptEnable registers in the interrupt
group 2. The output from the 6-input OR gate is connected to a latch, which is
controlled by InterruptPinEnable (bit 0 of the HcHardwareConfiguration register).
In the event in which the software wishes to temporarily disable the interrupt output of
the ISP1161A Host Controller, the following procedure should be followed:
1. Make sure that bit InterruptPinEnable in the HcHardwareConfiguration register is
set to logic 1.
2. Clear all bits in the Hc
μ
PInterrupt register.
3. Set bit InterruptPinEnable to logic 0.
Fig 20. HC interrupt logic.
MGT945
S
A
A
O
H
HcμPInterrupt
register
HcInterruptEnable
register
HcInterruptStatus
register
C
RHSC
FNO
UE
RD
SF
SO
RHSC
FNO
UE
RD
SF
SO
MIE
OR
S
A
A
O
H
HcμPInterruptEnable
register
C
OR
LATCH
INT1
group 2
InterruptPinEnable
HcHardwareConfiguration
register
g
LE
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1161 | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161A1 | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BD | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BM | Universal Serial Bus single-chip host and device controller |
| ISP1161BD | Full-speed Universal Serial Bus single-chip host and device controller |
相關代理商/技術參數 |
參數描述 |
|---|---|
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