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參數資料
| 型號： | ISP1161ABM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Full-speed Universal Serial Bus single-chip host and device controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-414-1, LQFP-64 |
| 文件頁數： | 55/134頁 |
| 文件大小： | 587K |
| 代理商： | ISP1161ABM |
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Philips Semiconductors
ISP1161A
Full-speed USB single-chip host and device controller
Product data
Rev. 03 — 23 December 2004
55 of 134
9397 750 13962
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
10.3 HC Root Hub registers
All registers included in this partition are dedicated to the USB Root Hub, which is an
integral part of the HC although it is functionally a separate entity. The Host Controller
Driver (HCD) emulates USBD accesses to the Root Hub via a register interface. The
HCD maintains many USB-defined hub features that are not required to be supported
in hardware. For example, the Hub’s Device, Configuration, Interface, Endpoint
Descriptors, as well as some static fields of the Class Descriptor, are maintained only
in the HCD. The HCD also maintains and decodes the Root Hub’s device address as
well as other minor operations more suited for software than for hardware.
The Root Hub registers were developed to match the bit organization and operation
of typical hubs found in the system.
Four 32-bit registers have been defined:
HcRhDescriptorA
HcRhDescriptorB
HcRhStatus
HcRhPortStatus[1:NDP]
Each register is read and written as a DWORD. These registers are only written
during initialization to correspond with the system implementation. The
HcRhDescriptorA and HcRhDescriptorB registers are writeable regardless of the
HC’s USB states. HcRhStatus and HcRhPortStatus are writeable during the
USBOperational state only.
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
15
14
13
12
11
10
9
8
reserved
0
R/W
5
LST[10:8]
1
R/W
1
0
0
0
0
1
0
R/W
7
R/W
6
R/W
4
R/W
3
R/W
2
R/W
0
LST[7:0]
0
0
1
0
1
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 27:
Bit
31 to 11
10 to 0
HcLSThreshold register: bit description
Symbol
Description
reserved
LST[10:0]
LSThreshold:
Contains a value that is compared to the
FrameRemaining field before a low-speed transaction is initiated.
The transaction is started only if FrameRemaining
≥
this field. The
value is calculated by the HCD, which considers transmission and
set-up overhead. Default value: 1576 (628H)
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1161 | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161A1 | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BD | Universal Serial Bus single-chip host and device controller |
| ISP1161A1BM | Universal Serial Bus single-chip host and device controller |
| ISP1161BD | Full-speed Universal Serial Bus single-chip host and device controller |
相關代理商/技術參數 |
參數描述 |
|---|---|
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