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參數資料
型號： ISP1161ABM
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： Full-speed Universal Serial Bus single-chip host and device controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
封裝： 7 X 7 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-414-1, LQFP-64
文件頁數： 51/134頁
文件大小： 587K
代理商： ISP1161ABM
Philips Semiconductors
ISP1161A
Full-speed USB single-chip host and device controller
Product data
Rev. 03 — 23 December 2004
51 of 134
9397 750 13962
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
writing logic 0 to a bit in this register leaves the corresponding bit in the
HcInterruptEnable register unchanged. On a read, the current value of the
HcInterruptEnable register is returned.
Code (Hex): 05 —
read
Code (Hex): 85 —
write
Table 18:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcInterruptDisable register: bit allocation
31
30
MIE
0
0
R/W
R/W
23
22
29
28
27
26
25
24
reserved
0
R/W
19
0
0
0
0
0
R/W
21
R/W
20
R/W
18
R/W
17
R/W
16
reserved
0
0
0
0
0
0
0
0
R/W
15
R/W
14
R/W
13
R/W
12
R/W
11
R/W
10
R/W
9
R/W
8
reserved
0
0
0
0
0
0
0
0
R/W
7
R/W
6
RHSC
0
R/W
R/W
5
FNO
0
R/W
R/W
4
UE
0
R/W
R/W
3
RD
0
R/W
R/W
2
SF
0
R/W
R/W
1
R/W
0
SO
0
R/W
reserved
0
R/W
reserved
0
R/W
Table 19:
Bit
31
HcInterruptDisable register: bit description
Symbol
Description
MIE
Logic 0 is ignored by the HC. Logic 1 disables interrupt generation
due to events specified in other bits of this register. This bit is set
after a hardware or software reset.
-
reserved
RHSC
0 —
ignore
30 to 7
6
1 —
disable interrupt generation due to Root Hub Status Change
0 —
ignore
5
FNO
1 —
disable interrupt generation due to Frame Number Overflow
0 —
ignore
4
UE
1 —
disable interrupt generation due to Unrecoverable Error
0 —
ignore
3
RD
1 —
disable interrupt generation due to Resume Detect
0 —
ignore
2
SF
1 —
disable interrupt generation due to Start of Frame
reserved
0 —
ignore
1
0
-
SO
1 —
disable interrupt generation due to Scheduling Overrun
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PDF描述
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