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參數資料
| 型號： | ISP1561 |
| 廠商： | NXP Semiconductors N.V. |
| 英文描述： | ISP1561BM |
| 中文描述： | ISP1561BM |
| 文件頁數： | 68/102頁 |
| 文件大小： | 2875K |
| 代理商： | ISP1561 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁當前第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁
Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
68 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
11.2.4
HceStatus register (address: value read from func0 or func1 of address
10H + 10CH)
The contents of the HceStatus register are returned on an I/O read of port 64H when
emulation is enabled. Reads and writes of port 60H and writes to port 64H can cause
changes in this register. Emulation software can directly access this register through
its memory address in the Host Controller’s operational register space. Accessing this
register through its memory address produces no side effects.
Table 94
contains the
bit allocation.
Bit
Symbol
Reset
Access
7
6
5
4
OUT_DATA[7:0]
0
R/W
3
2
1
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 93:
Bit
31 to 8
7 to 0
HceOutput register: bit description
Symbol
-
OUT_DATA[7:0]
OutputData
: This register holds the data that is returned when
an I/O read of port 60H is requested by application software.
Description
reserved
Table 94:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
HceStatus register: bit allocation
31
30
29
28
27
26
25
24
reserved
0
-
0
-
0
-
0
-
0
-
0
-
0
-
0
-
23
22
21
20
19
18
17
16
reserved
0
-
0
-
0
-
0
-
0
-
0
-
0
-
9
0
-
8
15
14
13
12
11
10
reserved
0
-
7
0
-
6
0
-
5
0
-
4
0
-
3
0
-
2
0
-
1
0
-
0
PARITY
TIMEOUT
AUX_OUT
_FULL
0
R/W
INH_SW
CMD_DATA
FLAG
IN_FULL
OUT_FULL
Reset
Access
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 95:
Bit
31 to 8
7
HceStatus register: bit description
Symbol
-
PARITY
Description
reserved
Parity
: This bit indicates parity error on keyboard and mouse
data.
Timeout
: This bit indicates a timeout.
6
TIMEOUT
相關PDF資料 |
PDF描述 |
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