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參數資料
| 型號： | ISP1581BD |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Universal Serial Bus 2.0 high-speed interface device |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64 |
| 文件頁數： | 59/73頁 |
| 文件大?。?/td> | 1819K |
| 代理商： | ISP1581BD |
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Philips Semiconductors
ISP1581
USB 2.0 HS interface device
Objective specification
Rev. 02 — 23 October 2000
59 of 73
9397 750 07648
Philips Electronics N.V. 2000. All rights reserved.
12.4.3
MDMA mode
Table 85: GMDA slave mode timing parameters
Symbol
Parameter
T
cy1
read/write cycle time
t
su1
DREQ set-up time before first DACK on
t
d1
DREQ on delay after last strobe off
t
h1
DREQ hold time after last strobe on
t
w1
DIOR/DIOW pulse width
t
d2
read data valid delay after strobe on
t
h2
read data hold time after strobe off
t
su2
write data set-up time before strobe off
Min
66.67
0
33.33
0
33.33
-
5
10
Max
-
-
-
33.33
-
10
-
-
Unit
ns
ns
ns
ns
ns
ns
ns
ns
(1) Programmable polarity: shown as active LOW.
(2) Programmable polarity: shown as active HIGH.
Fig 20. MDMA master mode timing.
(write) DATA[15:0]
(read) DATA[15:0]
DREQ
(2)
DACK
(1)
DIOR/DIOW
(1)
tw1
tw2
tsu1
tsu2
td2
tsu2
th1
th2
th3
Tcy1
MGT506
td1
td3
Table 86: MDMA mode timing parameters
Symbol
Parameter
T
cy1(min)
read/write cycle time (minimum)
[1]
t
w1(min)
DIOR/DIOW pulse width (minimum)
[1]
t
d1(max)
data valid delay after DIOR on
(maximum)
t
h3(min)
data hold time after DIOR off (minimum)
t
su2(min)
data set-up time before DIOR/DIOW off
(minimum)
t
h2(min)
data hold time after DIOW off (minimum)
t
su1(min)
DACK set-up time before DIOR/DIOW on
(minimum)
t
h1(min)
DACK hold time after DIOR/DIOW off
(minimum)
Mode 0
480
215
150
Mode 1
150
80
60
Mode 2
120
70
50
Unit
ns
ns
ns
5
100
5
30
5
20
ns
ns
20
0
15
0
10
0
ns
ns
20
5
5
ns
相關PDF資料 |
PDF描述 |
|---|---|
| ISP1582 | Hi-Speed Universal Serial Bus peripheral controller |
| ISP1582BS | Hi-Speed Universal Serial Bus peripheral controller |
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參數描述 |
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