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參數資料
型號: ISP1581BD
廠商: NXP SEMICONDUCTORS
元件分類: 總線控制器
英文描述: Universal Serial Bus 2.0 high-speed interface device
中文描述: UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
封裝: 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64
文件頁數: 65/73頁
文件大小: 1819K
代理商: ISP1581BD
Philips Semiconductors
ISP1581
USB 2.0 HS interface device
Objective specification
Rev. 02 — 23 October 2000
65 of 73
9397 750 07648
Philips Electronics N.V. 2000. All rights reserved.
[1]
Interlock time is the time allowed between an action by one agent and the following action by the other agent. An agent can be a sender
or a receiver. Interlocking actions require a response signal from the other agent before processing can continue.
13. Application information
t
d10
t
d11
t
d12
DACK off to IORDY high-Z delay
DACK on to IORDY HIGH delay
final strobe edge to DREQ off or DIOW
on delay
first strobe delay after control signal on
-
0
20
-
-
-
0
20
-
-
-
0
20
-
-
ns
ns
ns
50
50
50
t
d13
0
230
0
200
0
170
ns
Table 87: UDMA mode timing parameters
…continued
Symbol
Parameter
Mode 0
Min
Mode 1
Min
Mode 2
Min
Unit
Max
Max
Max
Fig 29. Typical interface connections for Generic Processor mode.
Fig 30. Typical interface connections for Split Bus mode.
MGT515
data
read strobe
16
ISP1581
CPU
DATA15 to DATA0
(R/W)/RD
address
8
AD7 to AD0
write strobe
DS/WR
chip select
CS
8
MGT516
DATA[15:0]
DREQ
ISP1581
DMA
8051
MICROCONTROLLER
AD7 to
AD0
INT
ALE/A0
P0.7/AD7
to
P0.0/AD0
ALE
DACK
DIOW
DIOR
write
strobe
read
strobe
interrupt
address
latch
enable
address/data
(R/W)/RD
DS/WR
RD
INTn
WR
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