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參數資料
| 型號： | LFX125EB-03F256C |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數： | 67/119頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 139K GATES 256-BGA |
| 標準包裝： | 90 |
| 系列： | ispXPGA® |
| 邏輯元件/單元數： | 1936 |
| RAM 位總計： | 94208 |
| 輸入/輸出數： | 160 |
| 門數： | 139000 |
| 電源電壓： | 2.3 V ~ 3.6 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 256-BGA |
| 供應商設備封裝： | 256-FPBGA（17x17） |
| 其它名稱： | 220-1237 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁當前第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁
Lattice Semiconductor
ispXPGA Family Data Sheet
47
ispXPGA 1200B/C & ispXPGA 1200EB/EC PIC Timing Parameters
Reset/Set
tLASSRO
Asynchronous Set/Reset to Output
—
1.09
—
1.17
—
1.35
ns
tLASSRPW
Asynchronous Set/Reset Pulse Width
4.19
—
4.50
—
5.18
—
ns
tLASSRR
Asynchronous Set/Reset Recovery
—
0.51
—
0.55
—
0.63
ns
tLSSR_S
Synchronous Set/Reset Setup Time
-0.03
—
-0.03
—
-0.03
—
ns
tLSSR_H
Synchronous Set/Reset Hold Time
0.03
—
0.03
—
0.03
—
ns
1. Only available for ispXPGA 1200B and ispXPGA 1200EB (2.5V/3.3V) devices.
Timing v.2.1
2. tLCTHRUL quoted bit by bit.
Parameter
Description
-5
1
-4
-3
Units
Min.
Max.
Min.
Max.
Min.
Max.
Register/Latch Delays
tIO_CO
Register Clock to Output Delay
—
1.01
—
1.09
—
1.25
ns
tIO_S
Register Setup Time (Data before Clock)
0.05
—
0.05
—
0.06
—
ns
tIO_H
Register Hold Time (Data after Clock)
0.06
—
0.06
—
0.07
—
ns
tIOCE_S
Register Clock Enable Setup Time
-0.03
—
-0.03
—
-0.03
—
ns
tIOCE_H
Register Clock Enable Hold Time
0.13
—
0.15
—
ns
tIO_GO
Latch Gate to Output Delay
—
0.85
—
0.91
—
1.05
ns
tIOL_S
Latch Setup Time
0.05
—
0.05
—
0.06
—
ns
tIOL_H
Latch Hold Time
0.06
—
0.06
—
0.07
—
ns
tIOLPD
Latch Propagation Delay (Transparent Mode)
—
0.09
—
0.10
—
0.12
ns
tIOASRO
Asynchronous Set/Reset to Output
—
1.17
—
1.26
—
1.45
ns
tIOASRPW
Asynchronous Set/Reset Pulse Width
4.19
—
4.50
—
5.18
—
ns
tIOASRR
Asynchronous Set/Reset Recovery Time
—
0.23
—
0.25
—
0.29
ns
Input/Output Delays
tIOBUF
Output Buffer Delay
—
0.99
—
1.06
—
1.22
ns
tIOIN
Input Buffer Delay
—
0.71
—
0.76
—
0.87
ns
tIOEN
Output Enable Delay
—
0.52
—
0.56
—
0.64
ns
tIODIS
Output Disable Delay
—
-0.11
—
-0.10
—
-0.09
ns
tIOFT
Feed-thru Delay
—
0.19
—
0.20
—
0.23
ns
1. Only available for ispXPGA 1200B and ispXPGA 1200EB (2.5V/3.3V) devices.
Timing v.2.1
ispXPGA 1200B/C & ispXPGA 1200EB/EC PFU Timing Parameters (Cont.)
Over Recommended Operating Conditions
Parameter
Description
-5
1
-4
-3
Units
Min.
Max.
Min.
Max.
Min.
Max.
SELECT
DEVICES
DISCONTINUED
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參數描述 |
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| LFX125EB-03F516C | 功能描述:FPGA - 現場可編程門陣列 139K 176 I/O ispJTAG RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFX125EB-03F516I | 功能描述:FPGA - 現場可編程門陣列 139K 176 I/O ispJTAG RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFX125EB-03FH516C | 功能描述:FPGA - 現場可編程門陣列 Use LFX125EB-03F516C RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| LFX125EB-03FH516I | 功能描述:FPGA - 現場可編程門陣列 Use LFX125EB-03F516I RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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