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參數資料
| 型號： | MC68HC05P18A |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low Cost HCMOS Microcontroller(低成本、8位HCMOS微控制器) |
| 中文描述： | 低成本HCMOS微控制器（低成本，8位HCMOS微控制器） |
| 文件頁數： | 70/130頁 |
| 文件大小： | 1200K |
| 代理商： | MC68HC05P18A |
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L
G
R
16-Bit Timer
Technical Data
MC68HC05P18A
70
16-Bit Timer
MOTOROLA
8.5 Input Capture
Two 8-bit read-only registers (ICRH and ICRL) make up the 16-bit input
capture. They are used to latch the value of the free-running counter
after a defined transition is sensed by the input capture edge detector.
NOTE:
The input capture edge detector contains a Schmitt trigger to improve
noise immunity.
The edge that triggers the counter transfer is defined by the input edge
bit (IEDG) in TCR. Reset does not affect the contents of the input
capture registers. See
Figure 8-8
.
The result obtained by an input capture will be one more than the value
ofthe free-runningcounter onthe risingedge ofthe PH2 clockpreceding
theexternaltransition(see
Figure8-9
).Thisdelayisrequiredforinternal
synchronization. Resolution is affected by the prescaler, allowing the
free-running counter to increment once every four PH2 clock cycles.
The contents of the free-running counter are transferred to the input
capture registers on each proper signal transition regardless of the state
of the input capture flag bit (ICF) in register TSR. The input capture
registers always contain the free-running counter value which
corresponds to the most recent input capture.
Address:
$0014
Bit 7
6
5
4
3
2
1
Bit 0
Read:
ICRH7
ICRH6
ICRH5
ICRH4
ICRH3
ICRH2
ICRH1
ICRH0
Write:
Reset:
Unaffected by reset
Address:
$0015
Bit 7
6
5
4
3
2
1
Bit 0
Read:
ICRL7
ICRL6
ICRL5
ICRL4
ICRL3
ICRL2
ICRL1
ICRL0
Write:
Reset:
Unaffected by reset
Figure 8-8. Input Capture Registers (ICRH/ICRL)
相關PDF資料 |
PDF描述 |
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參數描述 |
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