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參數(shù)資料
| 型號： | MC68HC08JB1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)(低成本、高性能M68HC08系列的8位微控制器(MCUs)) |
| 中文描述： | 低成本，高性能M68HC08系列系列的8位微控制器單元（MCU）（低成本，高性能M68HC08系列系列的8位微控制器（MCU）的） |
| 文件頁數(shù)： | 169/214頁 |
| 文件大小： | 2186K |
| 代理商： | MC68HC08JB1 |
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Input/Output Ports (I/O)
Port D
MC68HC08JB1
—
Rev. 1.0
Technical Data
MOTOROLA
Input/Output Ports (I/O)
169
PTD[1:0] — Port D Data Bit-1 and Bit-0
These two read/write bits are software programmable. Data direction
of PTD0/1 pin is under control of these two data bits. Reset has no
effect on port D data.
Configure this register so that PTD1 = PTD0.
The infrared LED drive bit, PTDILDD, in the port option control
register (POCR) controls the drive options for PTD[1:0]. (See
11.7
Port Options
.)
NOTE:
PTD1 and PTD0 internal pads are bonded together to PTD0/1 pin
forming a 50mA high current drain pin. When both PTD1 and PTD0 are
configured as output, the values of PTD0 and PTD1 should be written
the same.
11.5.2 Data Direction Register D
Data direction register D determines whether PTD0/1 pin is an input or
an output. Writing a logic 1 to DDRD[1:0] bits enable the output buffer for
the PTD0/1 pin; a logic 0 disables the output buffer.
DDRD[1:0] — Data Direction Register D Bit-1 and Bit-0
These two read/write bits control PTD0/1 pin data direction. Reset
clears DDRD[1:0], configuring PTD0/1 pin as an input.
Configure this register so that DDRD1 = DDRD0.
1 = PTD0/1 pin configured as output
0 = PTD0/1 pin configured as input
NOTE:
Avoid glitches on PTD0/1 pin by writing to PTD[1:0] before changing
DDRD[1:0] bits from 0 to 1.
Address:
$0007
Bit 7
6
5
4
3
2
1
Bit 0
Read:
0
0
0
0
0
0
DDRD1
DDRD0
Write:
Reset:
0
0
0
0
0
0
0
0
Figure 11-9. Data Direction Register D (DDRD)
相關(guān)PDF資料 |
PDF描述 |
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