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參數(shù)資料
型號: AD9824
廠商: Analog Devices, Inc.
英文描述: Complete 14-Bit 30 MSPS CCD Signal Processor
中文描述: 完整的14位30 MSPS的CCD信號處理器
文件頁數(shù): 11/24頁
文件大小: 438K
代理商: AD9824
REV. 0
AD9824
–11–
HD
*
0 = GAIN0, 1 = GAIN1, 2 = GAIN2
012012012...
012012012...
...01201
VD
LINE N
LINE N+1
Figure 12. PxGA Mode 3 (3-Color) Frame/Line Gain Register Sequence
SHP
HD
5 PIXEL MIN
PxGA
GAIN
GAIN1
VD
GAIN2
GAIN0
GAIN1
GAIN0
GAINX
GAIN0
GAINX
3ns MIN
5 PIXEL MIN
NOTES
1. BOTH VD AND HD ARE INTERNALLY UPDATED AT SHP RISING EDGES.
2. EVERY HD RISING EDGE WITH A PREVIOUS VD RISING EDGE WILL RESET TO 012012.
Figure 13. PxGA Mode 3 (3-Color) Detailed Timing
VD
HD
*
0 = GAIN0, 1 = GAIN1, 2 = GAIN2, 3 = GAIN3
LINE N
LINE N+1
012301230123...
...01230
01230123012...
Figure 14. PxGA Mode 4 (4-Color) Frame/Line Gain Register Sequence
SHP
HD
5 PIXEL MIN
PxGA
GAIN
GAIN1
VD
GAIN2
GAIN0
GAIN1
GAIN0
GAINX
GAIN0
GAINX
3ns MIN
5 PIXEL MIN
NOTES
1. BOTH VD AND HD ARE INTERNALLY UPDATED AT SHP RISING EDGES.
2. EVERY HD RISING EDGE WITH A PREVIOUS VD RISING EDGE WILL RESET TO 01230123.
Figure 15. PxGA Mode 4 (4-Color) Detailed Timing
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