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參數資料
型號: ADSP-21160M
廠商: Analog Devices, Inc.
元件分類: 數字信號處理
英文描述: DSP Microcomputer
中文描述: DSP微機
文件頁數: 41/53頁
文件大小: 696K
代理商: ADSP-21160M
41
REV. 0
ADSP-21160M
JTAG Test Access Port and Emulation
Table 28. JTAG Test Access Port and Emulation
Parameter
Timing Requirements:
t
TCK
t
STAP
t
HTAP
t
SSYS
t
HSYS
t
TRSTW
Switching Characteristics:
t
DTDO
t
DSYS
Min
Max
Unit
TCK Period
TDI, TMS Setup Before TCK High
TDI, TMS Hold After TCK High
System Inputs Setup Before TCK Low
1
System Inputs Hold After TCK Low
1
TRST Pulsewidth
t
CK
5
6
7
18
4t
CK
ns
ns
ns
ns
ns
ns
1
System Inputs = DATA63
0, ADDR31
0, RDx, WRx, ACK, SBTS, HBR, HBG, CS, DMAR1, DMAR2, BR6
1, ID2
0, RPBA, IRQ2
0, FLAG3
0,
PA, BRST, DR0, DR1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT7
0, LxCLK, LxACK, EBOOT, LBOOT, BMS, CLKIN,
RESET.
2
System Outputs = DATA63
0, ADDR31
0, MS3
0, RDx, WRx, ACK, PAGE, CLKOUT, HBG, REDY, DMAG1, DMAG2, BR6
1, PA, BRST, CIF,
FLAG3
0, TIMEXP, DT0, DT1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT7
0, LxCLK, LxACK, BMS.
TDO Delay from TCK Low
System Outputs Delay After TCK Low
2
13
30
ns
ns
Figure 28. IEEE 11499.1 JTAG Test Access Port
#
##
,
,
,
!
,
,
,
!
,
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PDF描述
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