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參數資料
| 型號： | ADSP-21MOD980N-000 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 通信及網絡 |
| 英文描述： | CAP 27PF 100V 10% X7R AXIAL BULK M-MIL-PRF-39014 |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PBGA352 |
| 封裝： | 35 X 35 MM, PLASTIC, BGA-352 |
| 文件頁數： | 25/42頁 |
| 文件大小： | 566K |
| 代理商： | ADSP-21MOD980N-000 |
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25
REV. PrB
6/2001
For current information contact Analog Devices at (800) ANALOGD
ADSP-21mod980N
PRELIMINARY TECHNICAL DATA
Clock and Reset Signals
Table 9. Clock and Reset Signals
Parameter
Description
Min.
Max
Unit
Clock signals (Timing Requirements):
t
CKI
CLKIN Period
25.0
40.0
ns
t
CKIL
CLKIN Width Low
8
ns
t
CKIH
CLKIN Width High
8
ns
t
CKRISE
CLKIN rise time
1
4
ns
t
CKFALL
CLKIN fall time
4
ns
Clock signals (Switching Characteristics)
2
:
t
CKL
CLKOUT Width Low
0.5t
CK
- 3
ns
t
CKH
CLKOUT Width High
0.5t
CK
- 3
ns
t
CKOH
CLKIN High to CLKOUT High
0
8
ns
Control Signals (Timing Requirements):
t
RSP
RESET Width Low
5t
CK
3
ns
t
MS
Mode Setup Before RESET High
4
ns
t
MH
Mode Hold After RESET High
5
ns
1
t
CKRISE
and t
CKFALL
are specified between the 10% and 90% points on the signal edge.
2
If it is not needed by the application, CLKOUT should be disabled to reduce noise (DM(0x3FF3) bit 14).
3
Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including
crystal oscillator start-up time).
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-21MSP58BST-104 | DSP Microcomputers |
| ADSP-BF531 | Blackfin Embedded Processor |
| ADSP-BF531SBBC400 | Metal Connector Backshell |
| ADSP-BF531SBBZ400 | Blackfin Embedded Processor |
| ADSP-BF531SBST400 | Circular Connector Series:97 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ADSP-21MSP50ABG-52 | 制造商:Analog Devices 功能描述: |
| adsp-21msp50akg-52 | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Analog Devices 功能描述: |
| ADSP-21MSP50BG-52 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| ADSP-21MSP50KG-52 | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| ADSP-21MSP52-520010 | 制造商:Analog Devices 功能描述: |
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