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參數(shù)資料
| 型號(hào)： | ADV7320 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | Multiformat 216 MHz Video Encoder with Six NSV 12-Bit DACs |
| 中文描述： | 多格式視頻編碼器216兆赫六噪聲整形的12位DAC |
| 文件頁(yè)數(shù)： | 14/88頁(yè) |
| 文件大小： | 1002K |
| 代理商： | ADV7320 |
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ADV7320/ADV7321
Rev. 0 | Page 14 of 88
Y0
Y1
Y2
Y3
b
a
Cb1
Cr1
Cr0
Cb0
c
Y OUTPUT
P_HSYNC
P_VSYNC
P_BLANK
Y9–Y0
C9–C0
a AND b AS PER RELEVANT STANDARD
c = PIPELINE DELAY. PLEASE REFER TO RELEVANT PIPELINE DELAY. THIS CAN BE FOUND IN THE TIMING SPECIFICATION
SECTION OF THE DATA SHEET.
A FALLING EDGE OF HSYNC IN TO THE ENCODER GENERATES A FALLING EDGE OF TRI-LEVEL SYNC ON THE OUTPUT
AFTER A TIME EQUAL TO THE PIPELINE DELAY.
0
Figure 15. HD 4:2:2 Input Timing Diagram
Y9–Y0
Cb
Y
Cr
Y
b
a
a = 32 CLKCYCLES FOR 525p
a = 24 CLKCYCLES FOR 625p
AS RECOMMENDED BY STANDARD
b(MIN) = 244 CLKCYCLES FOR 525p
b(MIN) = 264 CLKCYCLES FOR 625p
P_HSYNC
P_VSYNC
P_BLANK
0
Figure 16. PS 4:2:2 10-Bit Interleaved Input Timing Diagram
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADV7321 | Multiformat 216 MHz Video Encoder with Six NSV 12-Bit DACs |
| ADV7321KSTZ | Multiformat 216 MHz Video Encoder with Six NSV 12-Bit DACs |
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| ADV7340 | Multiformat Video Encoder, Six 12-Bit Noise Shaped Video㈢ DACS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ADV73205753 | 制造商:LG Corporation 功能描述:Frame Assembly |
| ADV73207202 | 制造商:LG Corporation 功能描述:Frame Assembly,Door |
| ADV73207203 | 制造商:LG Corporation 功能描述:FRAME ASSEMBLY,DOOR |
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