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參數(shù)資料
| 型號： | ISP1301BS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 通用總線功能 |
| 英文描述： | Universal Serial Bus On-The-Go transceiver |
| 中文描述： | LINE TRANSCEIVER, PQCC24 |
| 封裝： | 4 X 4 MM, 0.85 MM HEIGHT, LEAD FREE AND HALOGEN FREE, PLASTIC, MO-220, SOT-616-1, HVQFN-24 |
| 文件頁數(shù)： | 21/46頁 |
| 文件大小： | 245K |
| 代理商： | ISP1301BS |
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Philips Semiconductors
ISP1301
USB OTG transceiver
Product data
Rev. 01 — 14 April 2004
21 of 46
9397 750 11355
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
Interrupt Latch register (Set/Clear: 0AH/0BH):
This register indicates the source
that generated the interrupt. The bit allocation of the Interrupt Latch register is given
in
Table 27
.
Interrupt Enable Low register (Set/Clear: 0CH/0DH):
This register enables
interrupts on transition from true to false. For the bit allocation of this register, see
Table 29
.
Table 26:
Bit
7
6
Interrupt Source register: bit description
Symbol
Description
CR_INT
DP pin is above the car kit interrupt threshold (0.4 V to 0.6 V)
BDIS_ACON
set when bit BDIS_ACON_EN is set, and the ISP1301 asserts bit
DP_PULLUP after detecting the B-device disconnect
ID_FLOAT
ID pin is floating
DM_HI
DM pin is HIGH
ID_GND
ID pin is connected to ground
DP_HI
DP pin is HIGH
SESS_VLD
session valid comparator; threshold
=
0.8 V to 2.0 V
VBUS_VLD
A-device V
BUS
valid comparator; threshold > 4.4 V
5
4
3
2
1
0
Table 27:
Bit
Symbol
Interrupt Latch register: bit allocation
7
CR_INT
BDIS_
ACON
0
R/S/C
R/S/C
6
5
4
3
2
1
0
ID_FLOAT
DM_HI
ID_GND
DP_HI
SESS_VLD
VBUS_VLD
Reset
Access
0
0
0
0
0
0
0
R/S/C
R/S/C
R/S/C
R/S/C
R/S/C
R/S/C
Table 28:
Bit
7
6
5
4
3
2
1
0
Interrupt Latch register: bit description
Symbol
Description
CR_INT
interrupt for CR_INT status change
BDIS_ACON
interrupt for BDIS_ACON status change
ID_FLOAT
interrupt for ID_FLOAT status change
DM_HI
interrupt for DM_HI status change
ID_GND
interrupt for ID_GND status change
DP_HI
interrupt for DP_HI status change
SESS_VLD
interrupt for SESS_VLD status change
VBUS_VLD
interrupt for VBUS_VLD status change
Table 29:
Bit
Symbol
Interrupt Enable Low register: bit allocation
7
6
CR_INT
BDIS_
ACON
0
0
R/S/C
R/S/C
5
4
3
2
1
0
ID_FLOAT
DM_HI
ID_GND
DP_HI
SESS_VLD
VBUS_VLD
Reset
Access
0
0
0
0
0
0
R/S/C
R/S/C
R/S/C
R/S/C
R/S/C
R/S/C
相關PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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