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參數資料
| 型號： | ISP1301BS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 通用總線功能 |
| 英文描述： | Universal Serial Bus On-The-Go transceiver |
| 中文描述： | LINE TRANSCEIVER, PQCC24 |
| 封裝： | 4 X 4 MM, 0.85 MM HEIGHT, LEAD FREE AND HALOGEN FREE, PLASTIC, MO-220, SOT-616-1, HVQFN-24 |
| 文件頁數： | 5/46頁 |
| 文件大小： | 245K |
| 代理商： | ISP1301BS |
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Philips Semiconductors
ISP1301
USB OTG transceiver
Product data
Rev. 01 — 14 April 2004
5 of 46
9397 750 11355
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
7.2 Pin description
Table 2:
Symbol
[2]
Pin description
[1]
Pin
Type
[3]
Reset
value
high-Z
Description
ADR/PSW
1
I/O
ADR input —
sets the least-significant I
2
C-bus
address bit of the ISP1301; latched-on reset
(including power-on reset)
PSW output —
enables or disables the external
charge pump after reset
bidirectional; push-pull input; three-state output
serial I
2
C-bus data input and output
bidirectional; push-pull input; open-drain output
serial I
2
C-bus clock input and output
bidirectional; push-pull input; open-drain output
asynchronous reset; active LOW
push-pull input
interrupt output; active LOW
open-drain output
speed selection input for the ATX; effective when
bit SPD_SUSP_CTRL = 0:
LOW: low-speed
HIGH: full-speed.
push-pull input
output of the internal voltage regulator; an
external decoupling capacitor of 0.1
μ
F is
required
suspend selection input for ATX; effective when
bit SPD_SUSP_CTRL = 0:
LOW: normal operating
HIGH: suspend.
push-pull input
OE_N input —
enable driving DP and DM when
in the USB mode
SDA
2
I/OD
high-Z
SCL
3
I/OD
high-Z
RESET_N
4
I
-
INT_N
5
OD
high-Z
SPEED
6
I
-
V
REG(3V3)
7
P
-
SUSPEND
8
I
-
OE_N/
INT_N
9
I/O
high-Z
INT_N output —
interrupt (push pull) when
suspended and bit OE_INT_EN = 1
bidirectional; push-pull input; three-state output
single-ended DM receiver output
push-pull output
single-ended DP receiver output
push-pull output
differential receiver output; reflects the
differential value of DP and DM
push-pull output
VM
10
O
-
VP
11
O
-
RCV
12
O
0
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PDF描述 |
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參數描述 |
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