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參數資料
| 型號： | Q67100-Q2246 |
| 廠商： | SIEMENS AG |
| 英文描述： | 3.3V 16M x 64-Bit EDO-DRAM Module 3.3V 16M x 72-Bit EDO-DRAM Module |
| 中文描述： | 3.3 16米x 64位江戶內存3.3V的16米x 72位江戶記憶體模組 |
| 文件頁數： | 8/53頁 |
| 文件大小： | 418K |
| 代理商： | Q67100-Q2246 |
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HYB 39S64400/800/160BT(L)
64-MBit Synchronous DRAM
Data Book
8
12.99
DQM
LDQM
UDQM
Input
Pulse
Active
High
The Data Input/Output mask places the DQ buffers in a
high impedance state when sampled high. In Read mode,
DQM has a latency of two clock cycles and controls the
output buffers like an output enable. In Write mode, DQM
has a latency of zero and operates as a word mask by
allowing input data to be written if it is low but blocks the
write operation if DQM is high.
One DQM input it present in
×
4 and
×
8 SDRAMs, LDQM
and UDQM controls the lower and upper bytes in
×
16
SDRAMs.
V
DD
V
SS
Supply
–
–
Power and ground for the input buffers and the core logic.
V
DDQ
V
SSQ
Supply –
–
Isolated power supply and ground for the output buffers to
provide improved noise immunity.
V
REF
Input
Level
–
Reference voltage for SDRAM versions supporting SSTL
interface
Signal Pin Description
(cont’d)
Pin
Type
Signal Polarity Function
相關PDF資料 |
PDF描述 |
|---|---|
| Q67100-Q2330 | 8M x 32-Bit EDO-DRAM Module |
| Q67100-Q2366 | 4M x 36-Bit EDO - DRAM Module |
| Q67100-Q2367 | 4M x 36-Bit EDO - DRAM Module |
| Q67100-Q518 | 1 M x 1-Bit Dynamic RAM Low Power 1 M ⅴ 1-Bit Dynamic RAM |
| Q67100-Q519 | 1 M x 1-Bit Dynamic RAM Low Power 1 M ⅴ 1-Bit Dynamic RAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
| Q67100-Q2330 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:8M x 32-Bit EDO-DRAM Module |
| Q67100-Q2366 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:4M x 36-Bit EDO - DRAM Module |
| Q67100-Q2367 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:4M x 36-Bit EDO - DRAM Module |
| Q67100-Q2776 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:64-MBit Synchronous DRAM |
| Q67100-Q2781 | 制造商:INFINEON 制造商全稱:Infineon Technologies AG 功能描述:64-MBit Synchronous DRAM |
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