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參數資料

型號：	71M6543F-IGTR/F
廠商：	MAXIM INTEGRATED PRODUCTS INC
元件分類：	模擬信號調理
英文描述：	SPECIALTY ANALOG CIRCUIT, PQFP100
封裝：	LEAD FREE, LQFP-100
文件頁數：	125/157頁
文件大小：	2178K
代理商：	71M6543F-IGTR/F

第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁當前第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁

71M6543F/H and 71M6543G/GH Data Sheet

v1.2

2008–2011 Teridian Semiconductor Corporation

7

Table 49: Data/Direction Registers and Internal Resources for SEGDIO0 to SEGDIO15 ........................ 60

Table 50: Data/Direction Registers for SEGDIO16 to SEGDIO31........................................................... 61

Table 51: Data/Direction Registers for SEGDIO32 to SEGDIO45........................................................... 61

Table 52: Data/Direction Registers for SEGDIO51 to SEGDIO55........................................................... 61

Table 53: LCD_VMODE Configurations .................................................................................................. 63

Table 54: LCD Configurations................................................................................................................ 64

Table 55: LCD Data Registers for SEGDIO46 to SEGDIO55.................................................................. 65

Table 56: EECTRL Bits for 2-pin Interface............................................................................................... 66

Table 57: EECTRL Bits for the 3-wire Interface ....................................................................................... 67

Table 58: SPI Transaction Fields ........................................................................................................... 69

Table 59: SPI Command Sequences ..................................................................................................... 70

Table 60: SPI Registers......................................................................................................................... 70

Table 61: TMUX[4:0] Selections ............................................................................................................ 73

Table 62: TMUX2[4:0] Selections........................................................................................................... 74

Table 63: Available Circuit Functions ..................................................................................................... 77

Table 64: VSTAT[2:0] (SFR 0xF9[2:0]) ................................................................................................... 80

Table 65: Wake Enable and Flag Bits .................................................................................................... 82

Table 66: Wake Bits .............................................................................................................................. 83

Table 67: Clear Events for WAKE flags.................................................................................................. 84

Table 68: GAIN_ADJn Compensation Channels (Figure 2, Figure 31, Table 1) ...................................... 91

Table 69: GAIN_ADJx Compensation Channels (Figure 3, Figure 32, Table 2) ...................................... 93

Table 70: I/O RAM Map – Functional Order, Basic Configuration ........................................................... 98

Table 71: I/O RAM Map – Functional Order ......................................................................................... 100

Table 72: I/O RAM Map – Alphabetical Order ...................................................................................... 104

Table 73: Info Page Trim Fuses........................................................................................................... 118

Table 74: CE EQU[2:0] Equations and Element Input Mapping ............................................................ 121

Table 75: CE Raw Data Access Locations ........................................................................................... 122

Table 76: CESTATUS Register.............................................................................................................. 123

Table 77: CESTATUS Bit Definitions...................................................................................................... 123

Table 78: CECONFIG Register............................................................................................................. 123

Table 79: CECONFIG Bit Definitions (CE RAM 0x20) ........................................................................... 124

Table 80: Sag Threshold, Phase Measurement, and Gain Adjust Control............................................. 125

Table 81: CE Transfer Variables (with Shunts)..................................................................................... 125

Table 82: CE Transfer Variables (with CTs) ......................................................................................... 126

Table 83: CE Energy Measurement Variables (with Shunts)................................................................. 126

Table 84: CE Energy Measurement Variables (with CTs) ..................................................................... 126

Table 85: Other Transfer Variables ...................................................................................................... 127

Table 86: CE Pulse Generation Parameters......................................................................................... 128

Table 87: CE Parameters for Noise Suppression and Code Version..................................................... 129

Table 88: CE Calibration Parameters................................................................................................... 130

Table 89: Absolute Maximum Ratings.................................................................................................. 133

Table 90: Recommended External Components .................................................................................. 134

Table 91: Recommended Operating Conditions................................................................................... 134

Table 92: Input Logic Levels ................................................................................................................ 135

Table 93: Output Logic Levels ............................................................................................................. 135

Table 94: Battery Monitor Performance Specifications (TEMP_BAT = 1) ............................................... 136

Table 95: Temperature Monitor............................................................................................................ 137

Table 96: Supply Current Performance Specifications.......................................................................... 138

Table 98: Internal Power Fault Comparators Performance Specifications............................................. 139

Table 99: 2.5 V Voltage Regulator Performance Specifications ............................................................ 139

相關PDF資料	PDF描述
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