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參數(shù)資料
| 型號(hào)： | L64781 |
| 廠商： | LSI CORP |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| 封裝： | PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 86/164頁(yè) |
| 文件大小： | 2003K |
| 代理商： | L64781 |
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2-8
Architectural Overview
In analog timing recovery mode, the timing synchronization block
produces a control signal for the voltage-controlled oscillator (VCXO).
The control voltage of the VCXO is converted into a sigma-delta (
Σ/)
modulated signal and output from the Timing Synchronization block as a
single-wire signal. This signal requires external low-pass ltering to
extract its mean value, which represents the control voltage of the
oscillator.
2.6.1 Timing Loop Gain
In 2-K mode, the optimal IIRGAIN is 01, or
.
This leads to a
KI and KP values equal to:
In 8-K mode, the optimal IIRGAIN is 11, or
.
This leads to a
KI and KP values equal to:
2.6.2 TIM_CLK_INIT Register Denition
The TIM_CLK_INIT register is dened as a two’s-complement, 15-bit
register and in the L64781 has the following meaning:
with
W0 the central frequency of the VCXO.
2.6.3 TIM External Loop Filter
The input power control signal drives the sigma-delta (
Σ/) modulated
output, AGCOUT. Use the AGCOUT signal to drive an external passive
RC lter that feeds the gain control stage, as shown in Figure 2.4.
α 3.125
2
–
×10
≈
K
I
1.69
K
VCXO
--------------------
=
K
P
512
K
I
×
=
α 7.8
3
–
×10
≈
K
I
0.1
K
VCXO
--------------------
=
K
P
512
K
I
×
=
W
i
W
0
3.3
K
VCXO
T
× IMCLKINIT
()
2
15
------------------------------------------------------------------------------
+
=
l64781.book Page 8 Friday, January 19, 2001 1:28 PM
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