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參數(shù)資料
| 型號(hào)： | L64781 |
| 廠商： | LSI CORP |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| 封裝： | PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 96/164頁(yè) |
| 文件大小： | 2003K |
| 代理商： | L64781 |
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Viterbi Decoder
2-17
Hierarchical mode has two bit streams: LP and HP1. It is possible to
select one stream for the on-chip Viterbi decoder and another stream for
the external decoder.
To select the hierarchical mode, see the HIERARCHY register at 0x06
on page 5-24. To specify the DOF presentation output, see the
DOF_OUT_SEL eld in the Demod Parameters Register 5 at address
0x0B. DOF_OUT_SEL1 species that the HP/LP stream go to the
internal FEC; DOF_OUT_SEL0 species the external output for the
HP/LP stream.
2.18 Viterbi Decoder
The Viterbi decoder block performs an ITU digital video broadcast (DVB)
standard-compliant decode. This is an inner code block for a
concatenated decoding scheme. Features of this block include:
Programmable Viterbi code rates: 1/2, 2/3, 3/4, 5/6, and 7/8
Single clock with clock enable pin control
15-level soft-decision data input
Input in binary offset format
Constraint length 7
Decoded bit error rate monitor
Maximal likelihood (ML) decoding algorithm
5.2 dB coding gain for rate 1/2 (no erased input) code at BER of 10-5
Polynomial generation of 171 (Octal) and 133 (Octal)
2.19 Deinterleaver and Reed-Solomon Synchronizer
The data frames available at the output of the Viterbi decoder are the
input to the deinterleaver and Reed-Solomon (RS) synchronizer block.
The main function of this block is to search the data stream for a
predened synchronization byte to determine the in_sync or out_sync
condition. When the synchronization acquisition criteria are met, the
1. See the
ETSI Specication for a detailed description of LP/HP streams.
l64781.book Page 17 Friday, January 19, 2001 1:28 PM
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參數(shù)描述 |
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