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參數資料
| 型號： | AD9910BSVZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | DAC |
| 英文描述： | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
| 中文描述： | SERIAL, PARALLEL, WORD INPUT LOADING, 14-BIT DAC, PDSO100 |
| 封裝： | ROHS COMPLIANT, MS-026AED-HD, TQFP-100 |
| 文件頁數： | 7/60頁 |
| 文件大小： | 764K |
| 代理商： | AD9910BSVZ |
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AD9910
Parameter
CMOS LOGIC INPUTS
Logic 1 Voltage
Logic 0 Voltage
Logic 1 Current
Logic 0 Current
Input Capacitance
CMOS LOGIC OUTPUTS
Logic 1 Voltage
Logic 0 Voltage
POWER SUPPLY CURRENT
IAVDD (1.8 V)
IAVDD (3.3 V)
IDVDD (1.8 V)
IDVDD (3.3 V)
TOTAL POWER CONSUMPTION
Single Tone Mode
Rapid Power-Down Mode
Full Sleep Mode
1
The gain value for VCO range Setting 5 is measured at 1000 MHz.
2
Wake-up time refers to the recovery from analog power-down. The longest time required is for the Reference Clock Multiplier PLL to relock to the reference. The wake-
up time assumes there is no capacitor on DAC_BP and that the recommended PLL loop filter values are used.
3
SYSCLK cycle refers to the actual clock frequency used on-chip by the DDS. If the reference clock multiplier is used to multiply the external reference clock frequency,
the SYSCLK frequency is the external frequency multiplied by the reference clock multiplication factor. If the reference clock multiplier is not used, the SYSCLK
frequency is the same as the external reference clock frequency.
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Conditions/Comments
1 mA load
Min
Typ
90
38
2
110
29
222
11
715
330
19
Max
0.8
120
50
0.4
850
400
25
Unit
V
V
μA
μA
pF
V
V
mA
mA
mA
mA
mW
mW
mW
2.0
2.8
相關PDF資料 |
PDF描述 |
|---|---|
| AD9910BSVZ-REEL | 1 GSPS, 14-Bit, 3.3 V CMOS Direct Digital Synthesizer |
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相關代理商/技術參數 |
參數描述 |
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