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參數資料
| 型號： | ADUuC7027BSTZ62-RL |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | Precision Analog Microcontroller 12-bit Analog I/O, ARM7TDMI MCU |
| 中文描述： | 精密模擬微控制器的12位模擬I / O，ARM7TDMI的微控制器 |
| 文件頁數： | 15/92頁 |
| 文件大小： | 850K |
| 代理商： | ADUUC7027BSTZ62-RL |
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ADuC7019/20/21/22/24/25/26/27
Table 8. SPI Slave Mode Timing (PHASE Mode = 0)
Parameter
Description
t
CS
CS to SCLOCK edge
1
Rev. A | Page 15 of 92
Min
2 × t
HCLK
+
2 × t
UCLK
1 × t
UCLK
2 × t
UCLK
0
Typ
Max
Unit
ns
t
SL
t
SH
t
DAV
t
DSU
t
DHD
t
DF
t
DR
t
SR
t
SF
t
DOCS
t
SFS
1
t
UCLK
= 23.9 ns. It corresponds to the 41.78 MHz internal clock from the PLL before the clock divider.
2
t
HCLK
depends on the clock divider or CD bits in PLLCON MMR. t
HCLK
= t
UCLK
/2
CD
.
SCLOCK low pulse width
2
SCLOCK high pulse width
2
Data output valid after SCLOCK edge
Data input setup time before SCLOCK edge
1
Data input hold time after SCLOCK edge
1
Data output fall time
Data output rise time
SCLOCK rise time
SCLOCK fall time
Data output valid after CS edge
CS high after SCLOCK edge
(SPIDIV + 1) × t
HCLK
(SPIDIV + 1) × t
HCLK
5
5
5
5
25
12.5
12.5
12.5
12.5
25
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
0
SCLOCK
(POLARITY = 0)
CS
SCLOCK
(POLARITY = 1)
t
SH
t
SL
t
SR
t
SF
t
SFS
MISO
MOSI
t
CS
MSB IN
BITS 6–1
LSB IN
t
DHD
t
DSU
MSB
BITS 6–1
LSB
t
DOCS
t
DAV
t
DR
t
DF
Figure 9. SPI Slave Mode Timing (PHASE Mode = 0)
相關PDF資料 |
PDF描述 |
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| ADV101KN50 | Circular Connector; No. of Contacts:4; Series:LJT07R; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:9; Circular Contact Gender:Socket; Circular Shell Style:Jam Nut Receptacle; Insert Arrangement:9-44 |
| ADV101KN80 | Circular Connector; No. of Contacts:6; Series:LJT07R; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:9; Circular Contact Gender:Pin; Circular Shell Style:Jam Nut Receptacle; Insert Arrangement:9-6 |
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