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參數(shù)資料
| 型號： | A40MX04-VQG80A |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 6000 GATES, PQFP80 |
| 封裝： | PLASTIC, VQFP-80 |
| 文件頁數(shù)： | 13/78頁 |
| 文件大小： | 515K |
| 代理商： | A40MX04-VQG80A |
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40MX and 42MX Automotive FPGA Families
1- 16
v3.0
Timing Information
Note: * Values are shown for 40MX at worst-case 5.0V automotive conditions.
Figure 1-15 40MX Timing Model*
Notes:
*Values are shown for A42MX09 at worst-case 5.0V automotive conditions.
Input module predicted routing delay
Figure 1-16 42MX Timing Model*
Output Delay
Input Delay
I/O Module
INYL = 1.2 ns
IRD2 = 4.6 ns
Logic Module
PD = 2.2 ns
I/O Module
tRD1 = 2.3 ns
DLH = 5.9 ns
Array
Clock
MAX = 116 MHz
t RD4 = 5.1 ns
t RD8 = 8.8 ns
Predicted
Routing
Delays
CKH = 8.1 ns
FO = 128
= 3.7 ns
= 6.5 ns
= 10.2 ns
CO = 2.2 ns
ENHZ = 14.1 ns
tRD2 = 3.2 ns
Internal Delays
t
F
t
IRD1
IRD4
IRD8
t
Output Delays
I/O Module
t
DLH = 4.0 ns
I/O Module
tOUTH= 0.00 ns
tOUTSU= 0.4 ns
tGLH= 4.3 ns
t DLH= 4.0 ns
tENHZ = 8.2 ns
tRD1 = 1.1 ns
t
INH= 0.0 ns
tINSU= 0.4 ns
tINGL= 2.1 ns
Array
Clocks
tCKH = 4.0 ns
DQ
tCO= 2.1 ns
G
Internal Delays
Input Delays
I/O Module
DQ
tINYL= 1.3 ns
tIRD1 =
Combinatorial
Logic Module
t
PD = 2.0 ns
Sequential
Logic Module
t RD1= 1.1 ns
FMAX = 192 MHz
DQ
tSUD = 0.4 ns
tHD= 0.0 ns
tRD4 = 2.2 ns
tRD8 = 3.8 ns
Predicted
Routing
Delays
G
FO = 32
tRD2 = 1.6 ns
tLCO = 8.6 ns (light loads, pad-to-pad)
3.4 ns
Combin-
atorial
Logic
included
in tSUD
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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| A-40P24 | 制造商:Pentair Technical Products / Hoffman 功能描述:Panel 37.00x21.00 fits 40.00x2 制造商:PENTAIR TECNICAL PRODCUTS 功能描述:Panel 37.00x21.00 fits 40.00x2 |
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