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參數(shù)資料
| 型號(hào)： | AD9923ABBCZ |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | CCD Signal Processor with V-Driver and Precision Timing⑩ Generator |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA105 |
| 封裝： | 8 X 8 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-225, CSPBGA-105 |
| 文件頁(yè)數(shù)： | 15/88頁(yè) |
| 文件大小： | 852K |
| 代理商： | AD9923ABBCZ |
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AD9923A
Table 10.
Precision Timing
Edge Locations
Quadrant
I
II
III
IV
Rev. 0 | Page 15 of 88
Edge Location (Decimal)
0 to 11
12 to 23
24 to 35
36 to 47
Register Value (Decimal)
0 to 11
16 to 27
32 to 43
48 to 59
Register Value (Binary)
000000 to 001011
010000 to 011011
100000 to 101011
110000 to 111011
P[0]
P[48] = P[0]
P[12]
P[24]
P[36]
1 PIXEL
PERIOD
CLI
t
CLIDLY
POSITION
NOTES
1. THE PIXEL CLOCK PERIOD IS DIVIDED INTO 48 POSITIONS, PROVIDING FINE EDGE RESOLUTION FOR HIGH SPEED CLOCK.
2. THERE IS A FIXED DELAY FROM THE CLI INPUT TO THE INTERNAL PIXEL PERIOD POSITION (t
CLIDLY
= 6ns TYP).
0
Figure 17. High Speed Clock Resolution from CLI Master Clock Input
H1
H2
CCD
SIGNAL
RG
PROGRAMMABLE CLOCK POSITIONS:
1
RG RISING EDGE.
2
RG FALLING EDGE.
3
SHP SAMPLE LOCATION.
4
SHD SAMPLE LOCATION.
5
HL RISING EDGE POSITION.
6
HL FALLING EDGE POSITION.
7
H1 RISING EDGE POSITION.
8
H1 FALLING EDGE POSITION (H2 IS INVERSE OF H1).
9
H3 RISING EDGE POSITION.
10
H3 FALLING EDGE POSITION (H4 IS INVERSE OF H3).
H3
H4
3
4
1
2
7
8
HL
5
6
9
10
0
Figure 18. High Speed Clock Programmable Locations
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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