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參數資料
型號: ISP1183BS
廠商: NXP SEMICONDUCTORS
元件分類: 總線控制器
英文描述: Low-power Universal Serial Bus interface device with DMA
中文描述: UNIVERSAL SERIAL BUS CONTROLLER, PQCC32
封裝: 5 X 5 MM, 0.85 MM HEIGHT, PLASTIC, MO-220, SOT-617-1, HVQFN-32
文件頁數: 48/62頁
文件大小: 295K
代理商: ISP1183BS
Philips Semiconductors
ISP1183
Low-power USB interface device with DMA
Product data
Rev. 01 — 24 February 2004
48 of 62
9397 750 11804
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
18. Timing
18.1 Parallel I/O timing
[1]
The minimum value for the data flow commands (see
Table 13
) is 180 ns.
Table 55:
V
BUS
= V
REG(3V3)
= 2.7 V to 3.9 V; V
DD(I/O)
= 1.8 V
Symbol
Parameter
Read timing (see
Figure 13
)
t
RHAX
address hold time after RD_N HIGH
t
AVRL
address setup time before RD_N
LOW
t
RHDZ
data outputs high-impedance time
after RD_N HIGH
t
RHSH
chip deselect time after RD_N HIGH
t
RHRL
RD_N LOW after RD_N HIGH
t
RLRH
RD_N pulse width
t
SLRL
CS_N time before RD_N LOW
t
RLDV
data valid time after RD_N LOW
t
RC
(t
RHRL
+ t
RLRH
) read cycle time
Write timing (see
Figure 14
)
t
WHAX
address hold time after WR_N HIGH
t
AVWL
address setup time before WR_N
LOW
t
SLWL
CS_N time before WR_N LOW
t
WL
(t
WHWL
+ t
WLWH
)
t
WLWH
WR_N pulse width
t
WHWL
WR_N LOW after WR_N HIGH
t
WHSH
chip deselect time after WR_N HIGH
t
DVWH
data setup time before WR_N HIGH
t
WHDZ
data hold time after WR_N HIGH
Dynamic characteristics: parallel interface timing
Conditions
Min
Max
Unit
C
L
= 30 pF
0
0
-
-
ns
ns
0
-
ns
2
65
25
0
-
90
-
-
-
-
20
-
ns
ns
ns
ns
ns
ns
1
0
-
-
ns
ns
0
-
-
ns
ns
write cycle time
[1]
90/180
22
-
-
-
-
-
ns
ns
ns
ns
ns
[1]
68/158
0
2
1
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