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參數資料
| 型號： | ISP1183BS |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Low-power Universal Serial Bus interface device with DMA |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQCC32 |
| 封裝： | 5 X 5 MM, 0.85 MM HEIGHT, PLASTIC, MO-220, SOT-617-1, HVQFN-32 |
| 文件頁數： | 6/62頁 |
| 文件大小： | 295K |
| 代理商： | ISP1183BS |
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Philips Semiconductors
ISP1183
Low-power USB interface device with DMA
Product data
Rev. 01 — 24 February 2004
6 of 62
9397 750 11804
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
V
BUS
8
I
V
BUS
sensing input and power supply input; see
Section 8.11
USB D
line connection (analog)
USB D+ line connection (analog)
analog ground supply
regulated supply voltage (3.3 V
±
10 %) from internal
regulator; used to connect a 0.1
μ
F decoupling capacitor
and pull-up resistor on pin DP
Remark:
Cannot be used to supply external devices.
V
BUS
indicator output (active LOW); see
Table 3
DMA request output (4 mA; programmable polarity, see
Table 21
); signals to the DMA controller that the ISP1183
wants to start a DMA transfer
3.3 V tolerant I/O pad
DMA acknowledge input (programmable polarity, see
Table 21
); used by the DMA controller to signal the start of a
DMA transfer requested by the ISP1183; when not in use,
connect this pin to ground through a 10 k
resistor
3.3 V tolerant I/O pad
reset input (Schmitt trigger); a LOW level produces an
asynchronous reset
3.3 V tolerant I/O pad
address input; selects command (A0 = HIGH) or data
(A0 = LOW)
3.3 V tolerant I/O pad
I/O power supply; add a decoupling capacitor of 0.1
μ
F
(1.65 V to 3.6 V); see
Section 8.11
data bit 0 input and output
bidirectional (4 mA), 3.3 V tolerant I/O pad
data bit 1 input and output
bidirectional (4 mA), 3.3 V tolerant I/O pad
3.3 V output voltage; internally connected to the regulator
output; connect to a decoupling capacitor of 0.1
μ
F
digital ground supply
data bit 2 input and output
bidirectional (4 mA), 3.3 V tolerant I/O pad
data bit 3 input and output
bidirectional (4 mA), 3.3 V tolerant I/O pad
digital ground supply
data bit 4 input and output
bidirectional (4 mA), 3.3 V tolerant I/O pad
data bit 5 input and output
bidirectional (4 mA), 3.3 V tolerant I/O pad
DM
DP
AGND
V
REG(3V3)
9
10
11
12
AI/O
AI/O
-
-
VBUSDET_N
DREQ
13
14
O
O
DACK
15
I
RESET_N
16
I
A0
17
I
V
DD(I/O)
18
-
DATA0
19
I/O
DATA1
20
I/O
V
DD
21
-
DGND
DATA2
22
23
I/O
DATA3
24
I/O
DGND
DATA4
25
26
-
I/O
DATA5
27
I/O
Table 2:
Symbol
[1]
Pin description
…continued
Pin
Type Description
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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