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參數資料
| 型號： | MC68HC05L16 |
| 廠商： | Motorola, Inc. |
| 英文描述： | 80-Pin Microcontroller Unit (MCU) With Highly Sophisticated On-Chip Peripheral Functions(80腳、8位帶高級外圍電路功能的微控制器單元) |
| 中文描述： | 80管腳微控制器與高（MCU）的一套成熟的片上外設功能（80腳，8位帶高級外圍電路功能的微控制器單元） |
| 文件頁數： | 91/200頁 |
| 文件大小： | 1937K |
| 代理商： | MC68HC05L16 |
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Oscillators/Clock Distributions
OSC Clock Divider and POR Counter
MC68HC(7)05L16
—
Rev. 3.0
General Release Specification
MOTOROLA
Oscillators/Clock Distributions
91
L
G
R
7.3 OSC Clock Divider and POR Counter
The OSC clock is divided by a 7-bit counter which is used for the system
clock, timebase, and power-on reset (POR) counter. Clocks divided by
2, 4, and 64 are available for the system clock selections and a clock
divided by 128 is provided for the timebase and POR counter.
The POR counter is a 6-bit clock counter that is driven by the OSC
divided by 128. The overflow of this counter is used for setting FTUP bit,
releasing the POR, and resuming operation from stop mode.
The 7-bit divider and POR counter are initialized to $0078 by two
conditions:
Power-on detection
When FOSCE bit is cleared
7.4 System Clock Control
The system clock is provided for all internal modules except timebase.
Both OSC and XOSC are available as the system clock source. The
divide ratio is selected by the SYS1 and SYS0 bits in the MISC register.
(See
Table 7-1
.)
By default, OSC/64 is selected on reset.
NOTE:
Do not switch the system clock to XOSC (SYS1 and SYS0 = 11) when
XOSC clock is not available. The XOSC clock is available when STUP
flag is set.
Do not switch the system clock to OSC (SYS1 and SYS0 = 00, 01, or 10)
when OSC clock is not available. The OSC clock is available when
FTUP flag is set.
Table 7-1. System Bus Clock Frequency Selection
SYS1 SYS0
Divide Ratio
CPU Bus Frequency (Hz)
OSC = 4.0 M OSC = 4.1943 M XOSC = 32.768 k
0
0
OSC
÷
2
OSC
÷
4
OSC
÷
64
XOSC
÷
2
2.0 M
2.0972 M
—
0
1
1.0 M
1.0486 M
—
1
0
62.5 k
65.536 k
—
1
1
—
—
16.384 k
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