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參數資料
型號: MC68HC05L16
廠商: Motorola, Inc.
英文描述: 80-Pin Microcontroller Unit (MCU) With Highly Sophisticated On-Chip Peripheral Functions(80腳、8位帶高級外圍電路功能的微控制器單元)
中文描述: 80管腳微控制器與高(MCU)的一套成熟的片上外設功能(80腳,8位帶高級外圍電路功能的微控制器單元)
文件頁數: 99/200頁
文件大小: 1937K
代理商: MC68HC05L16
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Oscillators/Clock Distributions
Timebase
MC68HC(7)05L16
Rev. 3.0
General Release Specification
MOTOROLA
Oscillators/Clock Distributions
99
L
G
R
7.6.6 Timebase Control Register 2
Read
Anytime (Bits 3 and 0 are write-only bits and always read as logic 0.)
Write
Anytime (Bit 7 is a read-only bit and write has no effect; bit 1 is 1-time
write bit.)
TBIF — Timebase Interrupt Flag
TheTBIFbitisseteverytimeoutintervalofthetimebasecounter.This
read-only bit is cleared by writing a logic 1 to the RTBIF bit. Reset
clears the TBIF bit. The timebase interrupt period between reset and
the first TBIF depends on the time elapsed during reset, since the
timebase divider is not initialized on reset.
TBIE — Timebase Interrupt Enable
The TBIE bit enables the timebase interrupt capability. If TBIF = 1 and
TBIE = 1, the timebase interrupt is generated.
0 = Timebase interrupt disabled
1 = Timebase interrupt requested when TBIF = 1
TBR1 and TBR0 — Timebase Interrupt Rate Select
The TBR1 and TBR0 bits select one of four rates for the timebase
interrupt period (see
Table 7-3
). The TBS rate is also related to the
COP timeout reset period. These bits are set to logic 1 on reset.
Address:
$0011
Bit 7
6
5
4
3
2
1
Bit 0
Read:
TBIF
TBIE
TBR1
TBR0
0
0
0
0
Write:
RTBIF
COPE
COPC
Reset:
0
0
1
1
0
0
0
0
= Unimplemented
Figure 7-6. Timebase Control Register 2 (TBCR2)
相關PDF資料
PDF描述
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參數描述
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