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參數資料
| 型號： | THS8083APZPG4 |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| 封裝： | GREEN, PLASTIC, HTQFP-100 |
| 文件頁數： | 37/63頁 |
| 文件大小： | 320K |
| 代理商： | THS8083APZPG4 |
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53
5.3
Timing Diagram—48-Bit Interleaved Mode
This mode allows a double-pixel width output interface with one sampling clock period time offset between buses A
and B. The DATACLK1 output is at half of the sampling clock frequency. Data on output bus A precedes data on output
bus B.
DATACLK
CH1_OUTA[7..0]
CH2_OUTA[7..0]
CH2_OUTB[7..0]
CH1_OUTB[7..0]
CH3_OUTA[7..0]
CH3_OUTB[7..0]
HS
pix 01
01
03
02
04
pix 02
ADCCLK2
DHS
01
03
04
01
03
02
04
02
tPLH(OE)
tPHL(OE)
tsu(DHS)
th(DHS)
tsu(OUT)
th(OUT)
tsu(OUT)
th(OUT)
(DHS_POL = 0
Assumed-Inverted
Polarity Otherwise)
OE
7 ADCCLK2 Cycles Latency
Last Samples From Previous Line
<DHS_MODE> = 1 > Width
Equal to Width of HS Input
<DHS_MODE> = 0 > DHS
Width is 1 ADCCLK2 Period
7 ADCCLK2
Cycles Latency
相關PDF資料 |
PDF描述 |
|---|---|
| THS8083CPZP | SPECIALTY CONSUMER CIRCUIT, PQFP100 |
| THS8133ACPHP | PARALLEL, WORD INPUT LOADING, 0.005 us SETTLING TIME, 10-BIT DAC, PQFP48 |
| THS8133BCPHP | PARALLEL, WORD INPUT LOADING, 0.005 us SETTLING TIME, 10-BIT DAC, PQFP48 |
| THS8133BCPHPG4 | PARALLEL, WORD INPUT LOADING, 0.005 us SETTLING TIME, 10-BIT DAC, PQFP48 |
| THS8133CPHP | PARALLEL, WORD INPUT LOADING, 0.005 us SETTLING TIME, 10-BIT DAC, PQFP48 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| THS8083CPZP | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| THS8083EVM | 制造商:Texas Instruments 功能描述:THS8083EVM - Bulk |
| THS8083T | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Triple 8-Bit, 80 MSPS, 3.3-V Video and Graphics Digitizer With Digital PLL |
| THS8-10R-D | 制造商:Thomas & Betts 功能描述:CATAMOUNT CABLE TIES |
| THS8133 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:TRIPLE 10-BIT, 80 MSPS VIDEO D/A CONVERTER WITH TRI-LEVEL SYNC GENERATION WITH TRI-LEVEL SYNC GENERATION |
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