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參數資料
| 型號： | TSB12LV32-EP |
| 英文描述： | IC APEX 20KE FPGA 100K 324-FBGA |
| 中文描述： | 軍事增強塑料電機及電子學工程師聯合會1394-1995和P1394a兼容通用鏈路層控制器 |
| 文件頁數： | 57/106頁 |
| 文件大小： | 605K |
| 代理商： | TSB12LV32-EP |
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5
–
1
5 Data Mover Port Interface
The data mover (DM) port in the TSB12LV32 is the physical medium by which autonomous streams of
different types are piped to/from an application that uses the TSB12LV32. The DM port is meant to handle
an external memory interface of large data packets.
The DM port can support three types of packets:
Asynchronous
Isochronous
Asynchronous Streaming (1394a supported format)
The port can be configured to either transmit or receive data packets at one time (half duplex). A typical
system diagram is shown in Figure 5
–
1:
Application
Phy
Stream Process
(External Memory Interface)
TSB12LV32
μ
Processor/
μ
Controller
(ColdFire
)
Data Mover I/F
Microcontroller Interface
Phy/Link I/F
Figure 5
–
1. A Typical System Diagram
The DM port will perform all operations synchronously, utilizing a 24.576 MHz output clock called DMCLK.
DMCLK is essentially SCLK/2. There is no asynchronous logic within the DM block. All data transfers are
synchronized to the DMCLK output. The DM operates by setting the DM control register at 04h and the
control register at 08h of the CFR. The DM interfaces internally with the configuration register (CFR) block
and the link core (Link) block and interfaces externally with the data mover external interface.
The advantages of the DM port can be summarized as follows:
Transmits or receives large blocks of data at speeds up to 400 Mbits/s.
Allows for a large external FIFO specific to an individual application.
Handles asynchronous, isochronous, or asynchronous streaming packets.
相關PDF資料 |
PDF描述 |
|---|---|
| TSB12LV01B-EP | FPGA (Field-Programmable Gate Array) |
| TSB12LV01BPZ | FPGA (Field-Programmable Gate Array) |
| TSB12LV26-EP | 672-pin FineLine BGA |
| TSB12LV22PZP | OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER |
| TSB12LV26PZ | OHCI-Lynx PCI-BASED IEEE 1394 HOST CONTROLLER |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TSB12LV32I | 制造商:TI 制造商全稱:Texas Instruments 功能描述:IEEE 1394-1995 and P1394a Compliant General-Purpose Link-Layer Controller |
| TSB12LV32IPZ | 功能描述:1394 接口集成電路 General-Purpose Link Layer Cntrlr RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV32IPZEP | 制造商:Texas Instruments 功能描述:1394 I-TEMP 1394 GENERAL-PURPOSE LINK LAYER CONTROLLER (GP2L - Rail/Tube |
| TSB12LV32IPZG4 | 功能描述:1394 接口集成電路 General Purpose Link Layer Cntrlr RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
| TSB12LV32PZ | 功能描述:1394 接口集成電路 General-Purpose Link Layer Cntrlr RoHS:否 制造商:Texas Instruments 類型:Link Layer Controller 工作電源電壓: 封裝 / 箱體:LQFP 封裝:Tray |
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