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參數資料
| 型號： | ADSP-21266SKSTZ-2D |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | SHARC Embedded Processor |
| 中文描述： | 16-BIT, 66.67 MHz, OTHER DSP, PQFP144 |
| 封裝： | ROHS COMPLIANT, MS-026BFB, LQFP-144 |
| 文件頁數： | 21/44頁 |
| 文件大小： | 426K |
| 代理商： | ADSP-21266SKSTZ-2D |
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ADSP-21266
Rev. B
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May 2005
Timer PWM_OUT Cycle Timing
The timing specification in
Table 15
and
Figure 12
applies to
Timer in PWM_OUT (pulse-width modulation) mode. Timer
signals are routed to the DAI_P20
–
1 pins through the SRU.
Therefore, the timing specifications provided below are valid at
the DAI_P20
–
1 pins.
Timer WDTH_CAP Timing
The timing specification in
Table 16
and
Figure 13
applies to
Timer in WDTH_CAP (pulse width count and capture) mode.
Timer signals are routed to the DAI_P20
–
1 pins through the
SRU. Therefore, the timing specifications provided below are
valid at the DAI_P20
–
1 pins.
Table 15. Timer PWM_OUT Timing
Parameter
Switching Characteristic
t
PWMO
Min
Max
Unit
Timer Pulse Width Output
2 t
CCLK
– 1
2(2
31
– 1) t
CCLK
ns
Figure 12. Timer PWM_OUT Timing
DAI_P20–1
(TIMER)
t
PWMO
Table 16. Timer Width Capture Timing
Parameter
Timing Requirement
t
PWI
Min
Max
Unit
Timer Pulse Width
2 t
CCLK
2(2
31
– 1) t
CCLK
ns
Figure 13. Timer Width Capture Timing
DAI_P20–1
(TIMER)
t
PWI
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-21363 | SHARC Processor |
| ADSP-21363SBBC-ENG | SHARC Processor |
| ADSP-21363SBBCZENG | SHARC Processor |
| ADSP-21364 | SHARC Processor |
| ADSP-21364SBBC-ENG | SHARC Processor |
相關代理商/技術參數 |
參數描述 |
|---|---|
| ADSP-21267 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Preliminary Technical Data |
| ADSP-21267SKBCZ-X | 制造商:AD 制造商全稱:Analog Devices 功能描述:Preliminary Technical Data |
| ADSP-21267SKSTZ-X | 制造商:AD 制造商全稱:Analog Devices 功能描述:Preliminary Technical Data |
| ADSP-21362 | 制造商:AD 制造商全稱:Analog Devices 功能描述:SHARC Processor |
| adsp-21362bbc-1aa | 制造商:Analog Devices 功能描述: |
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